參數(shù)資料
型號(hào): LTC1417IGN
廠商: LINEAR TECHNOLOGY CORP
元件分類: ADC
英文描述: Low Power 14-Bit, 400ksps Sampling ADC Converter with Serial I/O
中文描述: 1-CH 14-BIT SUCCESSIVE APPROXIMATION ADC, SERIAL ACCESS, PDSO16
封裝: 0.150 INCH, PLASTIC, SSOP-16
文件頁數(shù): 19/32頁
文件大?。?/td> 394K
代理商: LTC1417IGN
19
LTC1417
APPLICATIO
S I
N
FOR
ATIO
U
Serial Data Output During a Conversion
W
U
Figure 17. Internal Conversion Clock Selected. Data Transferred During Conversion Using
the ADC Clock Output as a Master Shift Clock (SCLK Driven from CLKOUT)
D12
D11
D11
D12
CAPTURE ON
RISING CLOCK
D13
D10
D9
D8
D7
D6
D5
D4
D3
D2
D1
D0
FILL
ZEROS
D13
1
t
2
t
3
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
1
2
3
D13
D13
D12
D11
Hi-Z
Hi-Z
DATA N
DATA (N – 1)
t
CONV
(SAMPLE N)
(SAMPLE N + 1)
D
OUT
EXTCLKIN = 5
CLKOUT (= SCLK)
CONVST
t
10
t
5
SAMPLE
HOLD
HOLD
t
7
t
4
t
8
1417 F17
BUSY (= RD)
t
12
t
11
CLKOUT
(= SCLK)
V
IL
V
OH
V
OL
D
OUT
CAPTURE ON
FALLING CLOCK
LTC1417
BUSY (= RD)
CLKOUT ( = SCLK)
D
OUT
BUSY
CONVST
CONVST
RD
SCLK
CLKOUT
D
OUT
14
13
12
7
8
9
μ
P OR DSP
(CONFIGURED
AS SLAVE)
OR
SHIFT
REGISTER
Using Internal Clock
for Conversion and Data Transfer
.
Figure 17 shows data from the previous conversion being
clocked out during the conversion with the LTC1417
internal clock providing both the conversion clock and the
SCLK. The internal clock has been optimized for the fastest
conversion time; consequently, this mode can provide the
best overall speed performance. To select the internal
conversion clock, tie EXTCLKIN (Pin 6) high. The internal
clock appears on CLKOUT (Pin 8) which can be tied to
SCLK (Pin 7) to supply the SCLK.
相關(guān)PDF資料
PDF描述
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LTC1418AIN Low Power, 14-Bit, 200ksps ADC with Serial and Parallel I/O
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參數(shù)描述
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