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參數(shù)資料
| 型號： | LTC1417ACGN |
| 廠商： | LINEAR TECHNOLOGY CORP |
| 元件分類： | ADC |
| 英文描述： | Dual, Low Voltage, LinCMOS(TM) Differential Comparator 8-PDIP -40 to 85 |
| 中文描述： | 1-CH 14-BIT SUCCESSIVE APPROXIMATION ADC, SERIAL ACCESS, PDSO16 |
| 封裝： | 0.150 INCH, PLASTIC, SSOP-16 |
| 文件頁數(shù)： | 20/32頁 |
| 文件大?。?/td> | 394K |
| 代理商： | LTC1417ACGN |
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20
LTC1417
Using External Clock for Conversion and Data Transfer
.
In Figure 18, data from the previous conversion is output
during the conversion with an external clock providing
both the conversion clock and the shift clock. To select an
external conversion clock, apply the clock to EXTCLKIN.
The same clock is also applied to SCLK to provide a data
APPLICATIO
S I
N
FOR
ATIO
U
W
U
Figure 18. External Conversion Clock Selected. Data Transferred During Conversion Using
the External Clock (External Clock Drives Both EXTCLKIN and SCLK)
shift clock. To maintain conversion accuracy, the external
clock frequency must be between 50kHz and 9MHz.
Using an external clock to transfer data while an internal
clock controls the conversion process is not recom-
mended. As both signals are asynchronous, clock noise
can corrupt the conversion result.
D12
D11
D11
D12
CAPTURE ON
RISING CLOCK
D13
D10
D9
D8
D7
D6
D5
D4
D3
D2
D1
D0
FILL
ZEROS
D13
1
t
2
t
3
t
7
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
1
2
3
D13
D13
D12
D11
Hi-Z
Hi-Z
DATA N
DATA (N – 1)
t
CONV
(SAMPLE N)
(SAMPLE N + 1)
D
OUT
EXTCLKIN (= SCLK)
CONVST
t
10
t
5
SAMPLE
HOLD
HOLD
t
dEXTCLKIN
t
4
t
8
1417 F18
BUSY (= RD)
t
12
t
11
t
LEXTCLKIN
t
HEXTCLKIN
EXTCLKIN
(= SCLK)
V
IL
V
OH
V
OL
D
OUT
CAPTURE ON
FALLING CLOCK
LTC1417
BUSY (= RD)
EXTCLKIN ( = SCLK)
BUSY
CONVST
CONVST
RD
EXTCLKIN
SCLK
D
OUT
D
OUT
9
14
13
7
6
12
μ
P OR DSP
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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