參數(shù)資料
型號(hào)： LTC1291DCN8#PBF
廠商： Linear Technology
文件頁(yè)數(shù)： 4/20頁(yè)
文件大?。?/td> 0K
描述： IC DATA ACQ SYSTEM 12BIT 8-DIP
標(biāo)準(zhǔn)包裝： 50
類(lèi)型： 數(shù)據(jù)采集系統(tǒng)（DAS）
分辨率（位）： 12 b
數(shù)據(jù)接口： 串行，并聯(lián)
電壓電源： 單電源
電源電壓： 5V
工作溫度： 0°C ~ 70°C
安裝類(lèi)型： 通孔
封裝/外殼： 8-DIP（0.300"，7.62mm）
供應(yīng)商設(shè)備封裝： 8-PDIP
包裝： 管件
產(chǎn)品目錄頁(yè)面： 1346 (CN2011-ZH PDF)
12
LTC1291
1291fa
STAA
$102A
LOAD DUMMY DIN INTO SPI,
START SCK
WAIT3 LDAA
$1029
CHECK SPI STATUS REG
BPL
WAIT3
CHECK IF TRANSFER IS DONE
BSET
$08,X#$01
D0 GOES HIGH (CS GOES HIGH)
LDAA
$102A
LOAD LTC1291 LSBs IN ACC
STAA
$63
STORE LSBs IN $63
JMP
LOOP
START NEXT CONVERSION
Interfacing to the Parallel Port of the Intel 8051 Family
The Intel 8051 has been chosen to show the interface
between the LTC1291 and parallel port microprocessors.
Usually the signals CS, DIN and CLK are generated on three
port lines and the DOUT signal is read on a fourth port line.
LDAA
$1029
CHECK SPI STATUS REG
WAIT1 BPL
WAIT1
CHECK IF TRANSFER IS DONE
LDAA
$51
LOAD DIN INTO ACC A FROM $51
STAA
$102A
LOAD DIN INTO SPI, START SCK
WAIT2 LDAA
$1029
CHECK SPI STATUS REG
BPL
WAIT2
CHECK IF TRANSFER IS DONE
LDAA
$102A
LOAD LTC1291 MSBs INTO ACC A
STAA
$62
STORE MSBs IN $62
LDAA
$52
LOAD DUMMY DIN INTO ACC A
FROM $52
LABEL MNEMONIC
OPERAND
COMMENTS
LABEL MNEMONIC
OPERAND
COMMENTS
Timing Diagram for Interface to Intel 8051
Hardware and Software Interface to Intel 8051
LTC1291 AI09
DOUT FROM LTC1291 STORED IN 8051 RAM
00
0
B0
B2
B3
B1
B10
B11
LSB
MSB
R2
R1
B9
B8
B7
B6
B5
B4
CLK
DOUT
CS
ANALOG
INPUTS
P1.4
P1.3
8051
DIN
P1.2
MUX ADDRESS
A/D RESULT
LTC1291
CH0
CH1
This works very well. One can save a line by tying the DIN
and DOUT lines together. The 8051 first sends the start bit
and MUX Address to the LTC1291 over the line connected
to P1.2. Then P1.2 is reconfigured as an input and the 8051
reads back the 12-bit A/D result over the same data line.
CS
CLK
DATA
(DIN/DOUT)
LTC1291 AI08
13
24
5
PS BIT LATCHED
INTO LTC1291
8051 P1.2 OUTPUT DATA
TO LTC1291
8051 P1.2 RECONFIGURED
AS INPUT AFTER THE 5TH RISING
CLK BEFORE THE 5TH FALLING CLK
LTC1291 SENDS A/D RESULT
BACK TO 8051 P1.2
LTC1291 TAKES CONTROL OF DATA
LINE ON 5TH FALLING CLK
START
B11
SGL/
DIFF
ODD/
SIGN
MSBF
PS
B10 B9
B8
B7
B6
B5
B4
B3 B2
B1
B0
U
S
A
O
PPLICATI
WU
U
I FOR ATIO
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PDF描述
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