參數(shù)資料
型號： LT1949IS8
廠商： LINEAR TECHNOLOGY CORP
元件分類： 穩(wěn)壓器
英文描述： 600kHz, 1A Switch PWM DC/DC Converter
中文描述： 1.5 A SWITCHING REGULATOR, 750 kHz SWITCHING FREQ-MAX, PDSO8
封裝： 0.150 INCH, PLASTIC, SO-8
文件頁數(shù)： 4/8頁
文件大?。?/td> 158K
代理商： LT1949IS8
4
LT1949
V
C
(Pin 1):
Compensation Pin for Error Amplifier. Con-
nect a series RC network from this pin to ground. Typical
values for compensation are a 68k/330pF combination
when using ceramic output capacitors. Minimize trace
area at V
C
.
FB (Pin 2):
Feedback Pin. Reference voltage is 1.24V.
Connect resistor divider tap here. Minimize trace area at
FB. Set V
OUT
according to: V
OUT
= 1.24V(1 + R1/R2).
SHDN (Pin 3):
Shutdown. Pull this pin low for shutdown
mode (only the low-battery detector remains active).
Leave this pin floating or tie to a voltage between 1.4V and
6V to enable the device. SHDN pin is logic level and need
only meet the logic specification (1.4V for high, 0.4V for
low).
GND (Pin 4):
Ground. Connect directly to local ground
plane.
SW (Pin 5):
Switch Pin. Connect inductor/diode here.
Minimize trace area at this pin to keep EMI down.
V
IN
(Pin 6):
Supply Pin. Must be bypassed close to the
pin.
LBI (Pin 7):
Low-Battery Detector Input. 200mV refer-
ence. Voltage on LBI must stay between ground and
700mV. Low-battery detector remains active in shutdown
mode.
LBO (Pin 8):
Low-Battery Detector Output. Open collec-
tor, can sink 10
μ
A. A 1M
pull-up is recommended.
TYPICAL PERFOR U
Load Regulation
V
50mV/DIV
DC
COUPLED
OFFSET
ADDED
I
LOAD
25mA/DIV
V
IN
= 3V
V
= 10V
L1 = 10
μ
H, SUMIDA CD54
C
OUT
= 10
μ
F CERAMIC
1949 G10
Load Regulation
V
50mV/DIV
DC
COUPLED
OFFSET
ADDED
I
LOAD
50mA/DIV
V
IN
= 4V
V
= 10V
L1 = 10
μ
H, SUMIDA CD54
C
OUT
= 10
μ
F CERAMIC
1949 G11
Transient Response
V
100mV/DIV
AC COUPLED
50
μ
s/DIV
V
IN
= 3.3V
V
= 10V
CIRCUIT OF FIGURE 1
1949 G12
I
L
500mA/DIV
200mA
100mA
I
LOAD
TEMPERATURE (
°
C)
–50
Q
μ
A
26
25
24
23
22
21
20
–25
0
25
50
1317 TPC10
75
100
TEMPERATURE (
°
C)
–50
–25
0
25
50
75
100
F
1317 TPC11
40
36
32
28
24
20
16
12
8
4
0
Quiescent Current, SHDN = 0V
FB Pin Bias Current
SHDN Pin Current
SHDN PIN VOLTAGE (V)
0
S
μ
A
3
5
1317 TPC12
1
2
4
2
1
0
–1
–2
–3
6
PIU
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PDF描述
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參數(shù)描述
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