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參數(shù)資料
| 型號： | LSI53C1000R |
| 英文描述： | LSI53C1000R Ultra160 SCSI controller |
| 中文描述： | LSI53C1000R Ultra160的SCSI控制器 |
| 文件頁數(shù)： | 79/166頁 |
| 文件大?。?/td> | 1330K |
| 代理商： | LSI53C1000R |
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SAF-TE Module
3-31
Actual data transfers over the TWS bus are accomplished by
manipulating the TWS registers. Detailed information on these registers
is contained in the
LSI53C040 Enclosure Services Processor Technical
Manual
chapter entitled “TWS Registers.” Two TWS buses are available,
and the two separate sets of registers are located at addresses 0xFD00
through 0xFDFF in the external memory map. The SAF-TE source code
uses the mappings shown in
Table 3.7
:
On a write, the TWS bus transfers data from the external memory to a
peripheral. On a read, the TWS bus transfers the measurements or data
from the peripheral to external memory. These data are then used to
update the
config
data structure. The subroutines
tws_read
and
tws_write
control all of the serial data transfers through the TWS bus and
use the algorithms in Figures 2.11 and 2.12 in the
LSI53C040 Enclosure
Services Processor Technical Manual.
All reads and writes enable the
acknowledgment (bit 0) and clear all interrupts (bit 7) prior to a data
transfer. The use of the ACK results in 9 bits being transferred for every
byte requested. The ninth bit received is checked to determine that it is
a logical 0 (ACK). If this bit is not a logical 0, the read/write subroutines
return FALSE (error) to the calling program. If the transfer completes
successfully, these subroutines return TRUE (no error).
In general, the low-level TWS data transfer subroutines return TRUE if
processing is successful (no error) and FALSE if the directive failed.
Exceptions are noted in
Table 3.8
.
Table 3.7
SAF-TE Mappings
Variable Name
Descriptions
tws_data_ptr
Pointer to the TWS Own/Clock/Data Register
tws_car_ptr
Pointer to the TWS Control Register
相關PDF資料 |
PDF描述 |
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