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參數(shù)資料

型號(hào)：	LPC47N350
廠商：	SMSC Corporation
英文描述：	LEGACY FREE KEYBOARD EMBEDDED CONTROLLER WITH SPI AND LPC DOCKING INTERFACE
中文描述：	傳統(tǒng)的嵌入式免費(fèi)鍵盤和LPC對(duì)接的SPI接口控制器
文件頁(yè)數(shù)：	4/228頁(yè)
文件大?。?/td>	1269K
代理商：	LPC47N350

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SMSC DS – LPC47M192

Page 4

Rev. 03/30/05

DATASHEET

TABLE OF CONTENTS

GENERAL DESCRIPTION ....................................................................................................................3

PIN LAYOUT........................................................................................................................................10

PIN CONFIGURATION ........................................................................................................................11

DESCRIPTION OF PIN FUNCTIONS..................................................................................................12

4.1

UFFER

AME

ESCRIPTIONS

...........................................................................................................20

4.2

INS

HAT

EQUIRE

XTERNAL

ULLUP

ESISTORS

..........................................................................20

4.2.1

Super I/O Pins ........................................................................................................................................20

4.2.2

Hardware Monitoring Block Pins.............................................................................................................21

BLOCK DIAGRAM...............................................................................................................................22

POWER FUNCTIONALITY..................................................................................................................23

6.1

VCC/HVCC

OWER

........................................................................................................................23

6.1.1

3 VOLT OPERATION / 5 VOLT TOLERANCE.......................................................................................23

6.2

VREF

........................................................................................................................................23

6.3

VTR

UPPORT

.................................................................................................................................23

6.3.1

Trickle Power Functionality.....................................................................................................................23

6.4

32.768

RICKLE

LOCK

NPUT

...................................................................................................25

6.4.1

Indication of 32KHZ Clock ......................................................................................................................25

6.5

NTERNAL

PWRGOOD.....................................................................................................................25

6.6

AXIMUM

URRENT

ALUES

.............................................................................................................25

6.6.1

Super I/O Functions................................................................................................................................25

6.6.2

Hardware Monitoring Block Functions....................................................................................................26

6.7

OWER

ANAGEMENT

VENTS

(PME/SCI).......................................................................................26

FUNCTIONAL DESCRIPTION.............................................................................................................27

7.1

UPER

I/O

EGISTERS

.....................................................................................................................27

7.2

OST

ROCESSOR

NTERFACE

(LPC) ...............................................................................................27

7.3

LPC

NTERFACE

...............................................................................................................................28

7.3.1

LPC Interface Signal Definition...............................................................................................................28

7.3.2

LPC Cycles.............................................................................................................................................28

7.3.3

Field Definitions......................................................................................................................................28

7.3.4

LFRAME# Usage....................................................................................................................................28

7.3.5

I/O Read and Write Cycles .....................................................................................................................29

7.3.6

DMA Read and Write Cycles..................................................................................................................29

7.3.7

DMA Protocol .........................................................................................................................................29

7.3.8

POWER MANAGEMENT .......................................................................................................................29

7.3.8.1

CLOCKRUN Protocol....................................................................................................................................29

7.3.8.2

LPCPD Protocol..............................................................................................................................................29

7.3.9

SYNC Protocol .......................................................................................................................................29

7.3.9.1

Typical Usage .................................................................................................................................................29

7.3.9.2

SYNC Timeout ...............................................................................................................................................30

7.3.9.3

SYNC Patterns and Maximum Number of SYNCS........................................................................................30

7.3.9.4

SYNC Error Indication....................................................................................................................................30

7.3.9.5

I/O and DMA START Fields..........................................................................................................................30

7.3.9.6

Reset Policy.....................................................................................................................................................30

7.3.10

LPC TRANSFERS ..............................................................................................................................30

7.3.10.1

Wait State Requirements.................................................................................................................................30

7.4

LOPPY

ISK

ONTROLLER

..............................................................................................................31

7.4.1

FDC Internal Registers...........................................................................................................................31

7.4.2

STATUS REGISTER ENCODING..........................................................................................................41

7.4.3

Instruction Set.........................................................................................................................................48

7.4.4

DATA TRANSFER COMMANDS............................................................................................................54

7.4.5

DIRECT SUPPORT FOR TWO FLOPPY DRIVES.................................................................................64

相關(guān)PDF資料	PDF描述
LPC47N217	64 - PIN SUPUR I/O WITH LPC INTERFACE
LPC47N217-JN	64 - PIN SUPUR I/O WITH LPC INTERFACE
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相關(guān)代理商/技術(shù)參數(shù)	參數(shù)描述
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