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參數(shù)資料
| 型號： | LP62S2048M-10LLT |
| 廠商： | AMIC Technology Corporation |
| 英文描述： | 256K X 8 BIT LOW VOLTAGE CMOS SRAM |
| 中文描述： | 256K × 8位低電壓CMOS的SRAM |
| 文件頁數(shù)： | 2/17頁 |
| 文件大?。?/td> | 190K |
| 代理商： | LP62S2048M-10LLT |
LP62S2048-T Series
(August, 2001, Version 1.0)
2
AMIC Technology, Inc.
Block Diagram
ROW
DECODER
1024 X 2048
MEMORY ARRAY
INPUT DATA
CIRCUIT
COLUMN I/O
CONTROL
CIRCUIT
CE2
CE1
OE
WE
I/O
8
I/O
1
A17
A16
A15
A0
VCC
GND
Pin Description - SOP
Pin No.
Symbol
Description
1 - 12, 23,
25 - 28, 31
A0 - A17
Address Inputs
13 - 15,
17 - 21
I/O
1
- I/O
8
Data Input/Outputs
16
GND
Ground
22
CE1
Chip Enable
24
OE
Output Enable
29
WE
Write Enable
30
CE2
Chip Enable
32
VCC
Power Supply
Pin Descriptions - TSOP/TSSOP
Pin No.
Symbol
Description
1 - 4, 7,
9 - 20, 31
A0 - A17
Address Inputs
5
WE
Write Enable
6
CE2
Chip Enable
8
VCC
Power Supply
9
NC
No Connection
21 - 23,
25 - 29
I/O
1
- I/O
8
Data Input/Outputs
24
GND
Ground
30
CE1
Chip Enable
32
OE
Output Enable
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