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參數(shù)資料
| 型號(hào)： | LP62S1024BM-70LLT |
| 廠商： | AMIC Technology Corporation |
| 英文描述： | 128K X 8 BIT LOW VOLTAGE CMOS SRAM |
| 中文描述： | 128K的× 8位低電壓CMOS的SRAM |
| 文件頁(yè)數(shù)： | 3/18頁(yè) |
| 文件大?。?/td> | 197K |
| 代理商： | LP62S1024BM-70LLT |
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LP62S1024B-T Series
PRELIMINARY
(October, 2002, Version 0.1)
2
AMIC Technology, Corp.
Pin Configurations
n
SOP
n
TSOP/TSSOP
n
CSP (Chip Size Package)
36-pin Top View
NC
A16
A14
A12
A7
A6
A5
A4
A3
A2
A1
A0
I/O
1
I/O
2
I/O
3
I/O
4
GND
I/O
5
I/O
6
I/O
7
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A15
VCC
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L
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OE
L
(
1
16
17
32
CE1
WE
A0
I/O
5
I/O
6
GND
VCC
I/O
7
I/O
8
A9
A10
OE
A11
CE1
A12
A13
A14
A16
NC
NC
A15
I/O
4
I/O
3
I/O
2
I/O
1
GND
VCC
A1
A2
CE2
WE
NC
A5
A4
A3
A6
A7
A8
6
5
4
3
2
1
A
B
C
D
E
F
G
H
Pin No.
Pin
Name
Pin No.
Pin
Name
1
2
A9
3
4
5
6
7
8
9
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11
12
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14
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A8
A13
CE2
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VCC
NC
I/O
8
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A14
A12
A7
A6
A3
A2
A1
A0
I/O
1
I/O
2
GND
I/O
4
I/O
5
I/O
6
I/O
7
I/O
3
A11
WE
CE1
15
16
31
32
A5
A4
A10
OE
Block Diagram
ROW
DECODER
512 X 2048
MEMORY ARRAY
INPUT DATA
CIRCUIT
COLUMN I/O
CONTROL
CIRCUIT
CE2
CE1
OE
WE
I/O
8
I/O
1
A16
A15
A14
A0
VCC
GND
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| LP621024DX-55LLI | 128K X 8 BIT CMOS SRAM |
| LP621024DX-55LLT | 128K X 8 BIT CMOS SRAM |
| LP62S1024AM-55LLT | 128K X 8 BIT LOW VOLTAGE CMOS SRAM |
| LP62S1024AM-70LLT | 128K X 8 BIT LOW VOLTAGE CMOS SRAM |
| LP62S2048AM-70LLT | 256K X 8 BIT LOW VOLTAGE CMOS SRAM |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| LP62S1024B-T | 制造商:AMICC 制造商全稱:AMIC Technology 功能描述:128K X 8 BIT LOW VOLTAGE CMOS SRAM |
| LP62S1024BU-55LLI | 制造商:AMICC 制造商全稱:AMIC Technology 功能描述:128K X 8 BIT LOW VOLTAGE CMOS SRAM |
| LP62S1024BU-55LLIF | 制造商:AMICC 制造商全稱:AMIC Technology 功能描述:128K X 8 BIT LOW VOLTAGE CMOS SRAM |
| LP62S1024BU-55LLT | 制造商:AMICC 制造商全稱:AMIC Technology 功能描述:128K X 8 BIT LOW VOLTAGE CMOS SRAM |
| LP62S1024BU-70LLI | 制造商:AMICC 制造商全稱:AMIC Technology 功能描述:128K X 8 BIT LOW VOLTAGE CMOS SRAM |
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