參數(shù)資料
型號： LFXP6C-5F256C
廠商： Lattice Semiconductor Corporation
文件頁數(shù)： 237/397頁
文件大?。?/td> 0K
描述： IC FPGA 5.8KLUTS 188I/O 256-BGA
標準包裝： 90
系列： XP
邏輯元件/單元數(shù)： 6000
RAM 位總計： 73728
輸入/輸出數(shù)： 188
電源電壓： 1.71 V ~ 3.465 V
安裝類型： 表面貼裝
工作溫度： 0°C ~ 85°C
封裝/外殼： 256-BGA
供應(yīng)商設(shè)備封裝： 256-FPBGA（17x17）
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13-12
Lattice Semiconductor
LatticeXP sysCONFIG Usage Guide
while the other Lattice FPGA devices in the daisy chain operate in Slave Serial mode. The RESET/OE pin of the
PROM is driven by INITN while the Chip Select pin is driven by the DONE pin of the devices.
Figure 13-4. Master and Slave Serial Daisy Chain
Slave Parallel Mode
In Slave Parallel mode a host system sends the configuration data in a byte-wide stream to the device. The CCLK,
CSN, CS1N, and WRITEN pins are driven by the host system. The Slave Parallel configuration mode allows multi-
ple devices to be chained in parallel, as shown in Figure 13-5.
WRITEN, CSN, and CS1N must be held low to write to the device; data is input from D[0:7]. Slave Parallel mode
can also be used for readback of the internal configuration. By driving the WRITEN pin low, and CSN and CS1N
low, the device will input the readback instructions on the D[0:7] pins; WRITEN is then driven high and data read on
D[0:7]. In order to support readback the PERSISTENT bit in ispLEVER’s Preference Editor must be set to ON.
The Slave Parallel mode can support two types of overflow, Bypass and Flow-Through. If the Bypass option is set,
after the first device has received all of its configuration data, the data presented to the D[0:7] pins will be serialized
and bypassed to the DOUT pin. If the Flow-Through option is set, after the first device has received all of its config-
uration data, the CSON signal will drive the following parallel mode device’s chip select low as shown in Figure 13-
To support asynchronous configuration, where the host may provide data faster than the FPGA can accept it, Slave
Parallel mode can use the BUSY signal. By driving the BUSY signal high the Slave Parallel device tells the host to
pause sending data. See Figure 13-6.
Configuration Mode
CFG[1]
CFG[0]
CONFIG_MODE
Chain Mode
Slave Parallel (no overload option)
1
0
Slave_Parallel
Disable
Slave Parallel (Bypass ON)
1
0
Slave_Parallel
Bypass
Slave Parallel (Flow Through ON)
1
0
Slave_Parallel
Flowthrough
LatticeXP
Master Serial
CCLK
PROGRAMN
INITN
DONE
DIN
DOUT
CFG0
CFG1
LatticeXP
Slave Serial
CCLK
PROGRAMN
INITN
DONE
DIN
CFG1
CFG0
Master Program
Serial
PROM
DATA
CLK
RESET/OE
CS
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PDF描述
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LFXP6C-5QN208C 功能描述:FPGA - 現(xiàn)場可編程門陣列 5.8K LUTS 142 I/O RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
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