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參數(shù)資料
| 型號： | LFXP20C-5F484C |
| 廠商： | Lattice Semiconductor Corporation |
| 文件頁數(shù)： | 278/397頁 |
| 文件大小： | 0K |
| 描述： | IC FPGA 19.7KLUTS 340I/O 484-BGA |
| 標準包裝： | 60 |
| 系列： | XP |
| 邏輯元件/單元數(shù)： | 20000 |
| RAM 位總計： | 405504 |
| 輸入/輸出數(shù)： | 340 |
| 電源電壓： | 1.71 V ~ 3.465 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | 0°C ~ 85°C |
| 封裝/外殼： | 484-BBGA |
| 供應(yīng)商設(shè)備封裝： | 484-FPBGA（23x23） |
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Lattice Semiconductor FPGA
Lattice Semiconductor
Successful Place and Route
16-5
Board trace AC loading (Cbac): 60 pf.
Board trace parasitic capacitance (Cb): 5 pf.
Port controller input capacitance (Cp) :9 pf.
FPGA device input capacitance (Co): 9 pf.
The above information was specified under the following environmental conditions:
Maximum ambient temperature (Ta): 70 (C.
Estimated Power Consumption (Q): 2 W.
680 PBGAM Package Thermal resistance (
j) at 0 feet per minute (fpm) airflow: 13.4 °C/W.
The goal of this exercise is to compute the following device I/O constraints:
1. Input setup specification.
2. Input hold specification.
3. Maximum output propagation delay.
4. Minimum output propagation delay.
5. Output loading.
6. Temperature.
The only parameter which can be obtained from the above is the device junction temperature:
Tj =
j * Q - Ta
= 13.4 * 2 + 70
= 96.8 °C
The required constraints can be computed as follows:
1. Input setup specification
= P - PDMAXp - PDMAXb - Tskew
= 30 - 18 - 2 - 1
= 9 ns
2. Input hold specification
= PDMINp + PDMINb - Tskew
= 3 + 1 - 1
= 3 ns
3. Output maximum propagation delay requirement
= P - TSp - PDMAXb - Tskew
= 30 - 5 - 6 - 1
= 18 ns
4. Output minimum propagation delay requirement
= Thp - PDMINb + Tskew
= 3 - 1 + 1
= 3 ns
5. Output loading
= Cbac + Cb + Cp
= 60 + 5 + 9
= 74 pf
The preference file to use for this example is shown in Figure 16-3. For more preference language syntax and
examples, refer to the Constraints & Preferences section of the ispLEVER on-line help system.
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