參數(shù)資料
型號(hào)： LFXP20C-4FN484I
廠商： Lattice Semiconductor Corporation
文件頁(yè)數(shù)： 193/397頁(yè)
文件大?。?/td> 0K
描述： IC FPGA 19.7KLUTS 484FPBGA
標(biāo)準(zhǔn)包裝： 60
系列： XP
邏輯元件/單元數(shù)： 20000
RAM 位總計(jì)： 405504
輸入/輸出數(shù)： 340
電源電壓： 1.71 V ~ 3.465 V
安裝類(lèi)型： 表面貼裝
工作溫度： -40°C ~ 100°C
封裝/外殼： 484-BBGA
供應(yīng)商設(shè)備封裝： 484-FPBGA（23x23）
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LatticeECP/EC and LatticeXP
Lattice Semiconductor
sysCLOCK PLL Design and Usage Guide
11-16
DCS MODE = NEG
At the falling edge (NEG) of SEL, the DCSOUT changes from CLK0 to CLK1.
DCS MODE = HIGH_LOW
SEL is active high (HIGH) to select CLK1, and the disabled output is LOW.
DCS MODE = LOW_LOW
SEL is active low (LOW) to select CLK0, and the disabled output is LOW.
DCS MODE = HIGH_HIGH
SEL is active high (HIGH) to select CLK1, and the disabled output is HIGH.
DCS MODE = LOW_HIGH
SEL is active low (LOW) to select CLK0, and the disabled output is HIGH.
CLK0
CLK1
SEL
DCSOUT
SEL Falling edge:
- Wait for CLK1 falling edge,
latch output & remain low
- Switch output at CLK0 falling edge
SEL Rising edge:
- Wait for CLK0 falling edge,
latch output & remain low
- Switch output at CLK1 falling edge
DCS MODE = NEG
CLK1
SEL
DCSOUT
- Switch low at CLK1 falling edge.
- If SEL is low, output stays low at on
CLK1 rising edge. SEL must not
change during setup prior to rising clock.
DCS MODE = HIGH_LOW
CLK0
SEL
DCSOUT
- Switch low at CLK0 falling edge.
- If SEL is high, output stays low at
on CLK0 rising edge.
DCS MODE = LOW_LOW
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PDF描述
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