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參數(shù)資料
| 型號： | LFECP33E-5T144I |
| 廠商： | Lattice Semiconductor Corporation |
| 英文描述： | LatticeECP/EC Family Data Sheet |
| 中文描述： | LatticeECP / EC的系列數(shù)據(jù)手冊 |
| 文件頁數(shù)： | 23/117頁 |
| 文件大?。?/td> | 557K |
| 代理商： | LFECP33E-5T144I |
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2-20
Architecture
Lattice Semiconductor
LatticeECP/EC Family Data Sheet
Optimized DSP Functions
Lattice provides a library of optimized DSP IP functions. Some of the IPs planned for LatticeECP DSP are: Bit Cor-
relators, Fast Fourier Transform, Finite Impulse Response (FIR) Filter, Reed-Solomon Encoder/ Decoder, Turbo
Encoder/Decoders and Convolutional Encoder/Decoder. Please contact Lattice to obtain the latest list of available
DSP IPs.
Resources Available in the LatticeECP Family
Table 2-9 shows the maximum number of multipliers for each member of the LatticeECP family. Table 2-10 shows
the maximum available EBR RAM Blocks in each of the LatticeECP family. EBR blocks, together with Distributed
RAM can be used to store variables locally for the fast DSP operations.
Table 2-9. Number of DSP Blocks in LatticeECP Family
Table 2-10. Embedded SRAM in LatticeECP Family
DSP Performance of the LatticeECP Family
Table 2-11 lists the maximum performance in millions of MAC operations per second (MMAC) for each member of
the LatticeECP family.
Table 2-11. DSP Block Performance of LatticeECP Family
For further information on the sysDSP block, please see details of additional technical information at the end of this
data sheet.
Device
LFECP6
LFECP10
LFECP15
LFECP20
LFECP33
LFECP40
DSP Block
4
5
6
7
8
10
9x9 Multiplier
32
40
48
56
64
80
18x18 Multiplier
16
20
24
28
32
40
36x36 Multiplier
4
5
6
7
8
10
Device
LFECP6
LFECP10
LFECP15
LFECP20
LFECP33
LFECP40
EBR SRAM Block
10
30
38
46
58
70
Total EBR SRAM
(Kbits)
92
276
350
424
535
645
Device
LFECP6
LFECP10
LFECP15
LFECP20
LFECP33
LFECP40
DSP Block
4
5
6
7
8
10
DSP Performance
MMAC
3680
4600
5520
6440
7360
9200
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PDF描述 |
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