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參數(shù)資料
| 型號： | LFEC6E-5T144I |
| 廠商： | Lattice Semiconductor Corporation |
| 英文描述： | Octal D-type Edge-Triggered Flip-Flops With 3-State Outputs 20-SOIC -40 to 85 |
| 中文描述： | LatticeECP / EC的系列數(shù)據(jù)手冊 |
| 文件頁數(shù)： | 17/117頁 |
| 文件大?。?/td> | 557K |
| 代理商： | LFEC6E-5T144I |
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2-14
Architecture
Lattice Semiconductor
LatticeECP/EC Family Data Sheet
Figure 2-16. Memory Core Reset
For further information on sysMEM EBR block, please see the details of additional technical documentation at the
end of this data sheet.
sysDSP Block
The LatticeECP-DSP family provides a sysDSP block making it ideally suited for low cost, high performance Digital
Signal Processing (DSP) applications. Typical functions used in these applications are Finite Impulse Response
(FIR)
fi
lters; Fast Fourier Transforms (FFT) functions, correlators, Reed-Solomon/Turbo/Convolution encoders and
decoders. These complex signal processing functions use similar building blocks such as multiply-adders and mul-
tiply-accumulators.
sysDSP Block Approach Compare to General DSP
Conventional general-purpose DSP chips typically contain one to four (Multiply and Accumulate) MAC units with
fi
xed data-width multipliers; this leads to limited parallelism and limited throughput. Their throughput is increased by
higher clock speeds. The LatticeECP, on the other hand, has many DSP blocks that support different data-widths.
This allows the designer to use highly parallel implementations of DSP functions. The designer can optimize the
DSP performance vs. area by choosing appropriate level of parallelism. Figure 2-17 compares the serial and the
parallel implementations.
Q
SET
D
L
CLR
Output Data
Latches
Q
D
Memory Core
Port A[17:0]
SET
Port B[17:0]
RSTB
GSRN
Programmable Disable
RSTA
L
CLR
相關PDF資料 |
PDF描述 |
|---|---|
| LFECP10E-5Q208I | LatticeECP/EC Family Data Sheet |
| LFECP10E-5T100C | LatticeECP/EC Family Data Sheet |
| LFECP10E-5T100I | 12-Bit 66 kSPS ADC Ser. Out, Pgrmable MSB/LSB First, Pgrmable Power Down/Output Data Length, 11 Ch. 20-SSOP |
| LFECP10E-5T144C | LatticeECP/EC Family Data Sheet |
| LFECP10E-5T144I | LatticeECP/EC Family Data Sheet |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| LFEC6E-5TN100C | 制造商:LATTICE 制造商全稱:Lattice Semiconductor 功能描述:LatticeECP/EC Family Data Sheet |
| LFEC6E-5TN100I | 制造商:LATTICE 制造商全稱:Lattice Semiconductor 功能描述:LatticeECP/EC Family Data Sheet |
| LFEC6E-5TN144C | 功能描述:FPGA - 現(xiàn)場可編程門陣列 6.1 LUT 97 I/O RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256 |
| LFEC6E-5TN144I | 制造商:LATTICE 制造商全稱:Lattice Semiconductor 功能描述:LatticeECP/EC Family Data Sheet |
| LFEC6E-L-EV | 功能描述:可編程邏輯 IC 開發(fā)工具 Eval Board for EC6 RoHS:否 制造商:Altera Corporation 產(chǎn)品:Development Kits 類型:FPGA 工具用于評估:5CEFA7F3 接口類型: 工作電源電壓: |
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