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參數(shù)資料
| 型號(hào)： | LC4064ZC-5T48C |
| 廠商： | LATTICE SEMICONDUCTOR CORP |
| 元件分類： | PLD |
| 英文描述： | 3.3V/2.5V/1.8V In-System Programmable SuperFAST High density PDLs |
| 中文描述： | EE PLD, 5 ns, PQFP48 |
| 封裝： | 1 MM HEIGHT, TQFP-48 |
| 文件頁數(shù)： | 28/91頁 |
| 文件大?。?/td> | 851K |
| 代理商： | LC4064ZC-5T48C |
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Lattice Semiconductor
ispMACH 4000V/B/C/Z Family Data Sheet
28
t
PDLi
Propagation Delay through
Transparent Latch to Output/
Feedback MUX
—
0.25
—
0.25
—
0.25
—
0.25
ns
t
SRi
Asynchronous Reset or Set to
Output/Feedback MUX Delay
0.28
—
0.28
—
0.28
—
0.28
—
ns
t
SRR
Asynchronous Reset or Set
Recovery Time
1.67
—
1.67
—
1.67
—
1.67
—
ns
Control Delays
t
BCLK
t
PTCLK
t
BSR
t
PTSR
t
GPTOE
t
PTOE
GLB PT Clock Delay
—
1.12
—
1.12
—
1.12
—
1.12
ns
Macrocell PT Clock Delay
—
0.87
—
0.87
—
0.87
—
0.87
ns
Block PT Set/Reset Delay
—
1.83
—
1.83
—
1.83
—
1.83
ns
Macrocell PT Set/Reset Delay
—
1.11
—
1.41
—
1.51
—
1.61
ns
Global PT OE Delay
—
2.83
—
4.13
—
5.33
—
5.33
ns
Macrocell PT OE Delay
—
1.83
—
2.13
—
2.33
—
2.83
ns
Timing v.3.2
Note: Internal Timing Parameters are not tested and are for reference only. Refer to Timing Model in this data sheet for further details.
ispMACH 4000V/B/C Internal Timing Parameters (Cont.)
Over Recommended Operating Conditions
Parameter
Description
-2.5
-2.7
-3
-3.5
Units
相關(guān)PDF資料 |
PDF描述 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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