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參數(shù)資料
| 型號： | LC4064ZC-37T48C |
| 廠商： | LATTICE SEMICONDUCTOR CORP |
| 元件分類： | PLD |
| 英文描述： | 3.3V/2.5V/1.8V In-System Programmable SuperFAST High density PDLs |
| 中文描述： | EE PLD, 3.7 ns, PQFP48 |
| 封裝： | 1 MM HEIGHT, TQFP-48 |
| 文件頁數(shù)： | 39/91頁 |
| 文件大?。?/td> | 851K |
| 代理商： | LC4064ZC-37T48C |
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Lattice Semiconductor
ispMACH 4000V/B/C/Z Family Data Sheet
39
Boundary Scan Waveforms and Timing Speci
fi
cations
Symbol
Parameter
Min.
Max.
Units
t
BTCP
t
BTCH
t
BTCL
t
BTSU
t
BTH
t
BRF
t
BTCO
t
BTOZ
t
BTVO
t
BTCPSU
t
BTCPH
t
BTUCO
t
BTUOZ
t
BTUOV
TCK [BSCAN test] clock cycle
40
—
ns
TCK [BSCAN test] pulse width high
20
—
ns
TCK [BSCAN test] pulse width low
20
—
ns
TCK [BSCAN test] setup time
8
—
ns
TCK [BSCAN test] hold time
10
—
ns
TCK [BSCAN test] rise and fall time
50
—
mV/ns
TAP controller falling edge of clock to valid output
—
10
ns
TAP controller falling edge of clock to data output disable
—
10
ns
TAP controller falling edge of clock to data output enable
—
10
ns
BSCAN test Capture register setup time
8
—
ns
BSCAN test Capture register hold time
10
—
ns
BSCAN test Update reg, falling edge of clock to valid output
—
25
ns
BSCAN test Update reg, falling edge of clock to output disable
—
25
ns
BSCAN test Update reg, falling edge of clock to output enable
—
25
ns
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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| LC4064ZC-5M132C | 功能描述:CPLD - 復(fù)雜可編程邏輯器件 PROGRAMMABLE SUPER FAST HI DENSITY PLD RoHS:否 制造商:Lattice 系列: 存儲類型:EEPROM 大電池數(shù)量:128 最大工作頻率:333 MHz 延遲時間:2.7 ns 可編程輸入/輸出端數(shù)量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100 |
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