參數(shù)資料
型號(hào)： KS0125
廠商： SAMSUNG SEMICONDUCTOR CO. LTD.
英文描述： Multi-standard Video Encoder(多標(biāo)準(zhǔn)視頻編碼器)
中文描述： 多標(biāo)準(zhǔn)視頻編碼器（多標(biāo)準(zhǔn)視頻編碼器）
文件頁(yè)數(shù)： 11/36頁(yè)
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代理商： KS0125
MULTIMEDIA VIDEO
KS0125
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.
Figure 3. Pixel Data Alignment for 16 Bit Input
Figure 4. Pixel Data Alignment for 8 Bit Input
The reference point for pixel data setup and hold time is different for 27 MHz and 13.5 MHz clock inputs for 8 bit
input data. If the 27 MHz clock input is used, the reference point is the rising edge of the CKI27 input. If the 13.5
MHz clock input is used, the reference point is the rising edge of the CKO output.
For CCIR 601 input, the setup and hold time is always referenced to the rising edge of the clock input.
SLAVE MODE TIMING
In slave mode operation, the KS0125 synchronizes to externally generated timing signals, or EAV timing reference
codes embedded in the CCIR 656 data stream.
For CCIR 601 input, the internal horizontal timing counter is synchronized to the leading edge of the HSYN input.
The KS0125 assumes the first active pixel input starts 122 pixel clocks (13.5 MHz) after the leading edge of HSYN
for NTSC, or 132 pixel clocks for PAL. The line counter gets reset by the leading edge of VSYN. The internal field
counter is synchronized to the leading edge of either VSYN or ODD input. The programmable
FLD
bit in the control
HSYN
13.5 MHz
Cb0
Cr0
Cb2
Cr2
P[7:0]
Cb718 Cr718
64T
122T+HAV offset (NTSC)
132T+HAV offset (PAL)
720T
16T-HAV(NTSC)
12T-HAV(PAL)
Y0
Y1
Y2
Y3
P[15:8]
Y718
Y719
1T
HSYN
27 MHz
(CKI27 or
CKO)
Cb
Y
Cr
Y
P[7:0]
Cb
Y
Cr
Y
64T
122T+HAV offset (NTSC)
132T+HAV offset (PAL)
720T
16T-HAV(NTSC)
12T-HAV(PAL)
1T
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