參數(shù)資料
型號： KMPC853TVR66A
廠商： Freescale Semiconductor
文件頁數(shù)： 37/88頁
文件大?。?/td> 0K
描述： IC MPU PWRQUICC 166MHZ 256-PBGA
標(biāo)準(zhǔn)包裝： 2
系列： MPC8xx
處理器類型： 32-位 MPC8xx PowerQUICC
速度： 166MHz
電壓： 1.8V
安裝類型： 表面貼裝
封裝/外殼： 256-BGA
供應(yīng)商設(shè)備封裝： 256-PBGA（23x23）
包裝： 托盤
MPC853T Hardware Specification, Rev. 1
42
Freescale Semiconductor
IEEE 1149.1 Electrical Specifications
Figure 34 provides the reset timing for the debug port configuration.
Figure 34. Reset Timing—Debug Port Configuration
12 IEEE 1149.1 Electrical Specifications
Table 15 provides the JTAG timings for the MPC853T shown in Figure 35 to Figure 38.
Table 15. JTAG Timing
Num
Characteristic
All Frequencies
Unit
Min
Max
J82
TCK cycle time
100.00
—
ns
J83
TCK clock pulse width measured at 1.5 V
40.00
—
ns
J84
TCK rise and fall times
0.00
10.00
ns
J85
TMS, TDI data setup time
5.00
—
ns
J86
TMS, TDI data hold time
25.00
—
ns
J87
TCK low to TDO data valid
—
27.00
ns
J88
TCK low to TDO data invalid
0.00
—
ns
J89
TCK low to TDO high impedance
—
20.00
ns
J90
TRST assert time
100.00
—
ns
J91
TRST setup time to TCK low
40.00
—
ns
J92
TCK falling edge to output valid
—
50.00
ns
J93
TCK falling edge to output valid out of high impedance
—
50.00
ns
J94
TCK falling edge to output high impedance
—
50.00
ns
J95
Boundary scan input valid to TCK rising edge
50.00
—
ns
J96
TCK rising edge to boundary scan input invalid
50.00
—
ns
CLKOUT
SRESET
DSCK, DSDI
R70
R82
R80
R81
相關(guān)PDF資料
PDF描述
KMPC853TVR100A IC MPU PWRQUICC 100MHZ 256PBGA
IDT7054S20PRF IC SRAM 32KBIT 20NS 128TQFP
IDT70V657S15BF8 IC SRAM 1.125MBIT 15NS 208FBGA
IDT70V657S15BC8 IC SRAM 1.125MBIT 15NS 256BGA
IDT70V3579S5BF8 IC SRAM 1.125MBIT 5NS 208FBGA
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參數(shù)描述
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