參數(shù)資料
型號： KMC9328MX1CVM15
廠商： Freescale Semiconductor
文件頁數(shù)： 76/100頁
文件大?。?/td> 0K
描述： IC MCU I.MX 150MHZ 256-PBGA
標準包裝： 1
系列： i.MX1
核心處理器： ARM9
芯體尺寸： 32-位
速度： 150MHz
連通性： EBI/EMI，I²C，MMC，智能卡，SPI，SSI，UART/USART，USB
外圍設備： DMA，I²S，LCD，POR，PWM，WDT
輸入/輸出數(shù)： 110
程序存儲器類型： ROMless
電壓 - 電源 (Vcc/Vdd)： 1.7 V ~ 3.3 V
振蕩器型： 外部
工作溫度： -40°C ~ 85°C
封裝/外殼： 256-LBGA
包裝： 托盤
Functional Description and Application Information
MC9328MX1 Technical Data, Rev. 7
Freescale Semiconductor
77
4.12
Pulse-Width Modulator
The PWM can be programmed to select one of two clock signals as its source frequency. The selected
clock signal is passed through a divider and a prescaler before being input to the counter. The output is
available at the pulse-width modulator output (PWMO) external pin. Its timing diagram is shown in
Figure 56 and the parameters are listed in Table 32.
Figure 56. PWM Output Timing Diagram
12
MS_SDIO output delay time1,2
–3
ns
13
MS_SDIO input setup time for MS_SCLKO rising edge (RED bit = 0)3
18
–
ns
14
MS_SDIO input hold time for MS_SCLKO rising edge (RED bit = 0)3
0–
ns
15
MS_SDIO input setup time for MS_SCLKO falling edge (RED bit = 1)4
23
–
ns
16
MS_SDIO input hold time for MS_SCLKO falling edge (RED bit = 1)4
0–
ns
1 Loading capacitor condition is less than or equal to 30pF.
2 An external resistor (100 ~ 200 ohm) should be inserted in series to provide current control on the MS_SDIO pin,
because of a possibility of signal conflict between the MS_SDIO pin and Memory Stick SDIO pin when the pin
direction changes.
3 If the MSC2[RED] bit = 0, MSHC samples MS_SDIO input data at MS_SCLKO rising edge.
4 If the MSC2[RED] bit = 1, MSHC samples MS_SDIO input data at MS_SCLKO falling edge.
Table 32. PWM Output Timing Parameter Table
Ref No.
Parameter
1.8 ± 0.1 V
3.0 ± 0.3 V
Unit
Minimum
Maximum
Minimum
Maximum
1
System CLK frequency1
0870
100
MHz
2a
Clock high time1
3.3
–
5/10
–
ns
2b
Clock low time1
7.5
–
5/10
–
ns
3a
Clock fall time1
–5
–
5/10
ns
Table 31. MSHC Signal Timing Parameter Table (Continued)
Ref
No.
Parameter
3.0 ± 0.3 V
Unit
Minimum
Maximum
System Clock
2a
1
PWM Output
3b
2b
3a
4b
4a
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