Specifications ispLSI 5512VE 7 Figure 4. ispLSI 5000VE Macrocell PTSA DQ R P PTSA bypass PT Clock PT Reset Clk En R/L PTOE Shared PT Clock GOE0" />
參數(shù)資料
型號(hào)： ISPLSI 5512VE-155LB388
廠商： Lattice Semiconductor Corporation
文件頁(yè)數(shù)： 23/25頁(yè)
文件大小： 0K
描述： IC PLD ISP 256I/O 6.5NS 388BGA
標(biāo)準(zhǔn)包裝： 24
系列： ispLSI® 5000VE
可編程類(lèi)型： 系統(tǒng)內(nèi)可編程
最大延遲時(shí)間 tpd(1)： 6.5ns
電壓電源 - 內(nèi)部： 3 V ~ 3.6 V
邏輯元件/邏輯塊數(shù)目： 16
宏單元數(shù)： 512
門(mén)數(shù)： 24000
輸入/輸出數(shù)： 256
工作溫度： 0°C ~ 70°C
安裝類(lèi)型： 表面貼裝
封裝/外殼： 388-BBGA
供應(yīng)商設(shè)備封裝： 388-BGA（35x35）
包裝： 托盤(pán)
其它名稱： ISPLSI5512VE-155LB388
Specifications ispLSI 5512VE
7
Figure 4. ispLSI 5000VE Macrocell
PTSA
DQ
R P
PTSA bypass
PT Clock
PT Reset
Clk En
R/L
PTOE
Shared PT Clock
GOE0
GOE1
PT Preset
speed/
power
TOE
CLK0
CLK1
Clk
CLK2
CLK3
Global Reset
Shared PT Reset
Global PTOE 2
Global PTOE 3
Global PTOE 0
Global PTOE 1
VCCIO
VCC
Slew
rate
Open
drain
2.5V/3.3V
Output
I/O Pad
To GRP
Input threshold
2.5V/3.3V
Note: Not all macrocells have I/O pads.
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PDF描述
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