參數(shù)資料
型號(hào)： IRSLIDER2EK
廠商： Silicon Laboratories Inc
文件頁(yè)數(shù)： 84/250頁(yè)
文件大?。?/td> 0K
描述： BOARD EVAL IR SLIDER SI1142
標(biāo)準(zhǔn)包裝： 1
系列： QuickSense™
傳感器類型： 近程，紅外線
傳感范圍： 1 個(gè)滑塊
接口： USB
電源電壓： 5V，USB
嵌入式： 是，MCU，8 位
已供物品： 板
已用 IC / 零件： C8051F800，Si1142
其它名稱： 336-1972
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C8051F80x-83x
174
Rev. 1.0
SFR Address = 0xA1
SFR Definition 25.1. SPI0CFG: SPI0 Configuration
Bit
7654
3
2
1
0
Name
SPIBSY
MSTEN
CKPHA
CKPOL
SLVSEL
NSSIN
SRMT
RXBMT
Type
R
R/W
R
Reset
0000
0
1
Bit
Name
Function
7
SPIBSY
SPI Busy.
This bit is set to logic 1 when a SPI transfer is in progress (master or slave mode).
6
MSTEN
Master Mode Enable.
0: Disable master mode. Operate in slave mode.
1: Enable master mode. Operate as a master.
5
CKPHA
SPI0 Clock Phase.
0: Data centered on first edge of SCK period.*
1: Data centered on second edge of SCK period.*
4CKPOL
SPI0 Clock Polarity.
0: SCK line low in idle state.
1: SCK line high in idle state.
3
SLVSEL
Slave Selected Flag.
This bit is set to logic 1 whenever the NSS pin is low indicating SPI0 is the selected
slave. It is cleared to logic 0 when NSS is high (slave not selected). This bit does
not indicate the instantaneous value at the NSS pin, but rather a de-glitched ver-
sion of the pin input.
2
NSSIN
NSS Instantaneous Pin Input.
This bit mimics the instantaneous value that is present on the NSS port pin at the
time that the register is read. This input is not de-glitched.
1SRMT
Shift Register Empty (valid in slave mode only).
This bit will be set to logic 1 when all data has been transferred in/out of the shift
register, and there is no new information available to read from the transmit buffer
or write to the receive buffer. It returns to logic 0 when a data byte is transferred to
the shift register from the transmit buffer or by a transition on SCK. SRMT = 1 when
in Master Mode.
0
RXBMT
Receive Buffer Empty (valid in slave mode only).
This bit will be set to logic 1 when the receive buffer has been read and contains no
new information. If there is new information available in the receive buffer that has
not been read, this bit will return to logic 0. RXBMT = 1 when in Master Mode.
Note:
In slave mode, data on MOSI is sampled in the center of each data bit. In master mode, data on MISO is
sampled one SYSCLK before the end of each data bit, to provide maximum settling time for the slave device.
See Table 25.1 for timing parameters.
相關(guān)PDF資料
PDF描述
MLP1N06CL MOSFET N-CH 1A 62V TO-220AB
R1S8-3.315 CONV DC/DC 1W 3.3VIN 15VOUT
EEV-FC0J220R CAP ALUM 22UF 6.3V 20% SMD
R1S8-3.312 CONV DC/DC 1W 3.3VIN 12VOUT
100R17-203B CABLE FLAT FLEX 17POS 1MM 8"
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
IRSLIDEREK 功能描述:光學(xué)傳感器開(kāi)發(fā)工具 Si1120 Infrared Slider Demo RoHS:否 制造商:ams 工具用于評(píng)估: 接口類型: 最大工作溫度:
IRSM636-015MA 制造商:International Rectifier 功能描述:600V 999.000A MULTICHIP MODULES - Trays 制造商:International Rectifier 功能描述:MODULES POWER DRIVERS
IRSM636-015MATR 制造商:International Rectifier 功能描述:600V 999.000A MULTICHIP MODULES - Tape and Reel 制造商:International Rectifier 功能描述:MODULES POWER DRIVERS
IRSM636-015MATR-EL 制造商:International Rectifier 功能描述:
IRSM636-015MB 制造商:International Rectifier 功能描述:500V 999.000A MULTICHIP MODULES - Trays 制造商:International Rectifier 功能描述:MODULES POWER DRIVERS
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