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參數(shù)資料
| 型號： | IR80C52XXX-30SHXXX:RD |
| 廠商： | ATMEL CORP |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, MROM, 30 MHz, MICROCONTROLLER, CQCC44 |
| 封裝： | LCC-44 |
| 文件頁數(shù)： | 41/324頁 |
| 文件大?。?/td> | 3748K |
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135
2513L–AVR–03/2013
ATmega162/V
Interrupt Vector (See “Interrupts” on page 57.) is executed when the OCF1B Flag, located in
TIFR, is set.
Bit 3 – TICIE1: Timer/Counter1, Input Capture Interrupt Enable
When this bit is written to one, and the I-flag in the Status Register is set (interrupts globally
enabled), the Timer/Counter1 Input Capture interrupt is enabled. The corresponding Interrupt
Vector (See “Interrupts” on page 57.) is executed when the ICF1 Flag, located in TIFR, is set.
Extended
Timer/Counter
Interrupt Mask
Register – ETIMSK
Note:
1. This register contains interrupt control bits for several Timer/Counters, but only Timer3 bits are
described in this section. The remaining bits are described in their respective Timer sections.
Bit 5 – TICIE3: Timer/Counter3, Input Capture Interrupt Enable
When this bit is written to one, and the I-flag in the Status Register is set (interrupts globally
enabled), the Timer/Counter3 Input Capture interrupt is enabled. The corresponding Interrupt
Vector (See “Interrupts” on page 57.) is executed when the ICF3 Flag, located in TIFR, is set.
Bit 4 – OCIE3A: Timer/Counter3, Output Compare A Match Interrupt Enable
When this bit is written to one, and the I-flag in the Status Register is set (interrupts globally
enabled), the Timer/Counter3 Output Compare A Match interrupt is enabled. The corresponding
Interrupt Vector (See “Interrupts” on page 57.) is executed when the OCF3A Flag, located in
TIFR, is set.
Bit 3 – OCIE3B: Timer/Counter3, Output Compare B Match Interrupt Enable
When this bit is written to one, and the I-flag in the Status Register is set (interrupts globally
enabled), the Timer/Counter3 Output Compare B Match interrupt is enabled. The corresponding
Interrupt Vector (See “Interrupts” on page 57.) is executed when the OCF3B Flag, located in
TIFR, is set.
Bit 2 – TOIE3: Timer/Counter3, Overflow Interrupt Enable
When this bit is written to one, and the I-flag in the Status Register is set (interrupts globally
enabled), the Timer/Counter3 overflow interrupt is enabled. The corresponding Interrupt Vector
(See “Interrupts” on page 57.) is executed when the TOV3 Flag, located in TIFR, is set.
Timer/Counter
Interrupt Flag Register
– TIFR(1)
Note:
1. This register contains flag bits for several Timer/Counters, but only Timer1 bits are described
in this section. The remaining bits are described in their respective Timer sections.
Bit 7 – TOV1: Timer/Counter1, Overflow Flag
The setting of this flag is dependent of the WGMn3:0 bits setting. In Normal and CTC modes,
the TOV1 Flag is set when the timer overflows. Refer to Table 56 on page 130 for the TOV1 Flag
behavior when using another WGMn3:0 bit setting.
Bit
7
6
5
4
3
2
1
0
TICIE3
OCIE3A
OCIE3B
TOIE3
–
–ETIMSK
Read/Write
R
R/W
R
Initial Value
0
Bit
765
4321
0
TOV1
OCF1A
OC1FB
OCF2
ICF1
TOV2
TOV0
OCF0
TIFR
Read/Write
R/W
Initial Value
000
0000
0
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MC80C32E-36/883:D | 8-BIT, 36 MHz, MICROCONTROLLER, CDIP40 |
| MQ80C32-30SBR | 8-BIT, 30 MHz, MICROCONTROLLER, CQFP44 |
| MR80C32E-30 | 8-BIT, 30 MHz, MICROCONTROLLER, CQCC44 |
| R80C32E-44 | 8-BIT, 44 MHz, MICROCONTROLLER, CQCC44 |
| MC8259A | 8086; 8088; 80186 COMPATIBLE, INTERRUPT CONTROLLER, CDIP28 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| IR80C86-2 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:16-Bit Microprocessor |
| IR80C88 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:16-Bit Microprocessor |
| IR80C88-2 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:16-Bit Microprocessor |
| IR-820 | 制造商:BOWEI 制造商全稱:BOWEI 功能描述:Image Rejection Mixers |
| IR8200 | 制造商:IRF 制造商全稱:International Rectifier 功能描述:3A, 55V DMOS H-BRIDGE |
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