參數(shù)資料
型號： IF180C52CXXX-36
廠商： TEMIC SEMICONDUCTORS
元件分類： 微控制器/微處理器
英文描述： 8-BIT, MROM, 36 MHz, MICROCONTROLLER, PQFP44
文件頁數(shù)： 118/1301頁
文件大?。?/td> 5589K
代理商： IF180C52CXXX-36
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1103
SAM9X35 [DATASHEET]
11055E–ATARM–10-Mar-2014
46.6.9 Two Dimension Scaler
The High End Overlay (HEO) data path includes a hardware scaler that allows image resize in both horizontal and
vertical direction.
46.6.9.1 Horizontal Scaler
The XMEM_SIZE field of the LCDC_HEOCFG4 register indicates the horizontal size minus one of the image in the
system memory. The XSIZE field of the LCDC_HEOCFG3 register contains the horizontal size minus one of the window.
The SCALEN field of the LCDC_HEOCFG13 register is set to one. The scaling factor is programmed in the XFACTOR
field of the LCDC_HEOCFG13 register.
46.6.9.2 Vertical Scaler
The YMEM_SIZE field of the LCDC_HEOCFG4 register indicates the vertical size minus one of the image in the system
memory. The YSIZE field of the LCDC_HEOCFG3 register contains the vertical size minus one of the window. The
SCALEN field of the LCDC_HEOCFG13 register is set to one. The scaling factor is programmed in the YFACTOR field of
the LCDC_HEOCFG13 register.
46.6.10 Hardware Cursor
The LCD module integrates a hardware cursor database. This layer features only a minimal set of color among 1, 2, 4
and 8 bpp palletized and 16 bpp to 32 bpp true color. The cursor size is limited to 128 x 128 pixels.
46.6.11 Color Combine Unit
46.6.11.1 Window Overlay
The LCD module provides hardware support for multiple “overlay plane” that can be used to display windows on top of
the image without destroying the image located below. The overlay image can use any color depth. Using the overlay
alleviates the need to re-render the occluded portion of the image. When pixels are combined together through the alpha
blending unit, a new color is created. This new pixel is called an iterated pixel and is passed to the next blending stage.
Then, this pixel may be combined again with another pixel. The VIDPRI field located in the LCDC_HEOCFG12 register
configures the video priority algorithm used to display the layers. When VIDPRI field is set to zero the OVR1 layer is
located above the HEO layer. When VIDPRI field is set to one, OVR1 is located below the HEO layer.
XFACTOR
floor
1024
XMEMSIZE 1
+
()
×
XSIZE 1
+
()
------------------------------------------------------------------
=
YFACTOR
floor
1024
YMEMSIZE 1
+
()
×
YSIZE 1
+
()
-----------------------------------------------------------------
=
相關(guān)PDF資料
PDF描述
IF180C52EXXX-12:R 8-BIT, MROM, 12 MHz, MICROCONTROLLER, PQFP44
IJ80C52CXXX-36SHXXX:RD 8-BIT, MROM, 36 MHz, MICROCONTROLLER, CQCC44
IS80C52XXX-12SHXXX:D 8-BIT, MROM, 12 MHz, MICROCONTROLLER, PQCC44
ID8751H 8-BIT, UVPROM, MICROCONTROLLER, CDIP40
R8751H 8-BIT, UVPROM, MICROCONTROLLER, CQCC44
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
IF180C52-L16 制造商:未知廠家 制造商全稱:未知廠家 功能描述:8-Bit Microcontroller
IF180C52T-12 制造商:未知廠家 制造商全稱:未知廠家 功能描述:8-Bit Microcontroller
IF180C52T-16 制造商:未知廠家 制造商全稱:未知廠家 功能描述:8-Bit Microcontroller
IF180C52T-20 制造商:未知廠家 制造商全稱:未知廠家 功能描述:8-Bit Microcontroller
IF180C52T-25 制造商:未知廠家 制造商全稱:未知廠家 功能描述:8-Bit Microcontroller
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