VLOAD
參數(shù)資料
型號(hào)： IDTQS3VH16233PAG
廠商： IDT, Integrated Device Technology Inc
文件頁(yè)數(shù)： 7/8頁(yè)
文件大?。?/td> 0K
描述： IC BUS SWITCH 32:16 56TSSOP
標(biāo)準(zhǔn)包裝： 34
系列： 3VH
類(lèi)型： 總線開(kāi)關(guān)
電路： 1 x 32:1
獨(dú)立電路： 1
輸出電流高，低： 15mA，30mA
電壓電源： 單電源
電源電壓： 2.3 V ~ 3.6 V
工作溫度： -40°C ~ 85°C
安裝類(lèi)型： 表面貼裝
封裝/外殼： 56-TFSOP（0.240"，6.10mm 寬）
供應(yīng)商設(shè)備封裝： 56-TSSOP
包裝： 管件
其它名稱(chēng)： IDTQS3VH16233PAG-ND
QS3VH16233PAG
7
INDUSTRIALTEMPERATURERANGE
IDTQS3VH16233
2.5V / 3.3V 32:16 MUX/DEMUX HIGH BANDWIDTH BUS SWITCH
Open
VLOAD
GND
VCC
Pulse
Generator
D.U.T.
500
Ω
500
Ω
CL
RT
VIN
VOUT
(1, 2)
SAME PHASE
INPUT TRANSITION
OPPOSITE PHASE
INPUT TRANSITION
0V
VOH
VOL
tPLH
tPHL
tPLH
OUTPUT
VIH
VT
VIH
VT
CONTROL
INPUT
tPLZ
0V
OUTPUT
NORMALLY
LOW
tPZH
0V
SWITCH
CLOSED
OUTPUT
NORMALLY
HIGH
ENABLE
DISABLE
SWITCH
OPEN
tPHZ
0V
VOL + VLZ
VOH
VT
tPZL
VLOAD/2
VIH
VT
VOL
VOH -VHZ
TEST CIRCUITS AND WAVEFORMS
Enable and Disable Times
NOTE:
1. Diagram shown for input Control Enable-LOW and input Control Disable-HIGH.
Propagation Delay
Test Circuits for All Outputs
DEFINITIONS:
CL = Load capacitance: includes jig and probe capacitance.
RT = Termination resistance: should be equal to ZOUT of the Pulse Generator.
NOTES:
1. Pulse Generator for All Pulses: Rate
≤ 1.0MHz; tF ≤ 2.5ns; tR ≤ 2.5ns.
2. Pulse Generator for All Pulses: Rate
≤ 1.0MHz; tF ≤ 2ns; tR ≤ 2ns.
SWITCH POSITION
Test
Switch
tPLZ/tPZL
VLOAD
tPHZ/tPZH
GND
tPD
Open
TEST CONDITIONS
Symbol
VCC(1)= 3.3V ± 0.3V
VCC(2)= 2.5V ± 0.2V
Unit
VLOAD
6
2 x Vcc
V
VIH
3
Vcc
V
VT
1.5
VCC/2
V
VLZ
300
150
mV
VHZ
300
150
mV
CL
50
30
pF
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PDF描述
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