參數資料
型號: IDTCV119EPVG8
廠商: IDT, Integrated Device Technology Inc
文件頁數: 2/21頁
文件大?。?/td> 0K
描述: IC CLK GEN DESKTOP PC 48-SSOP
標準包裝: 1,000
類型: 時鐘/頻率發(fā)生器
PLL:
主要目的: SATA CPU
輸入: 晶體
輸出: 時鐘
電路數: 1
比率 - 輸入:輸出: 1:21
差分 - 輸入:輸出: 無/是
頻率 - 最大: 533MHz
電源電壓: 3.135 V ~ 3.465 V
工作溫度: 0°C ~ 70°C
安裝類型: 表面貼裝
封裝/外殼: 48-BSSOP(0.295",7.50mm 寬)
供應商設備封裝: 48-SSOP
包裝: 帶卷 (TR)
其它名稱: CV119EPVG8
COMMERCIALTEMPERATURERANGE
10
IDTCV119E
CLOCKGENERATORFORDESKTOPPCPLATFORMS
BYTE 24
Bit
Output(s) Affected
Description/Function
0
1
Type
Power On
7
WDHRB
WD hard alarm status read back
R
6
WDSRB
WD soft alarm status read back
R
5
4
3
2
0
1
FSR1
HW FS1 read back
R
HW FS1
0
FSR0
HW FS0 read back
R
HW FS0
BYTE 25: CPU PLL CONTROL
Bit
Output(s) Affected
Description/Function
0
1
Type
Power On
7
CPU frequency band source select
0 = selected by HW latched FS[1:0], CFS[2:0]
HW
SW
RW
0
1 = selected by BS[2:0], CFS[2:0]
6
BS2, Band select 2
BS[2:0] CFS[2:0] select CPU frequency(1)
RW
0
5
BS1, Band select 1
BS[2:0] CFS[2:0] select CPU frequency(1)
RW
0
4
BS0, Band select 0
BS[2:0] CFS[2:0] select CPU frequency(1)
RW
0
3
CFS2
BS[2:0] CFS[2:0] select CPU frequency(1)
RW
0
2
CFS1
BS[2:0] CFS[2:0] select CPU frequency(1)
RW
0
1
CFS0
BS[2:0] CFS[2:0] select CPU frequency(1)
RW
0
CPU N Programming Enable
Disable
Enable
RW
0
NOTES:
1. See SW FREQUENCY SELECTION table.
BYTE 23
Bit
Output(s) Affected
Description/Function
0
1
Type
Power On
Recommended
7
48MHz0
Outputenable
Tristate
Enable
RW
1
6
24_48MHz
Outputenable
Tristate
Enable
RW
1
5
REF1
Outputenable
Tristate
Enable
RW
1
4
REF0
Outputenable
Tristate
Enable
RW
1
3
Reserve
10
2
Reserve
Outputenable
Tristate
Enable
RW
1
0
1
Reserve
Outputenable
Tristate
Enable
RW
1
0
Reserve
0
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