參數資料
型號： IDTCSPU877ANLG8
廠商： INTEGRATED DEVICE TECHNOLOGY INC
元件分類： 時鐘及定時
英文描述： 877 SERIES, PLL BASED CLOCK DRIVER, 10 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PQCC40
封裝： GREEN, PLASTIC, MLF-40
文件頁數： 3/13頁
文件大小： 115K
代理商： IDTCSPU877ANLG8
11
IDTCSPU877A
1.8V PLL DIFFERENTIAL 1:10 SDRAM CLOCK DRIVER
COMMERCIALTEMPERATURERANGE
Input and Output Slew Rates
APPLICATION INFORMATION
Clock Loading on the PLL outputs (pF)
Clock Structure
# of SDRAM Loads per Clock
Min.
Max.
#1
2
3
5
#2
4
6
10
TEST CIRCUIT AND SWITCHING WAVEFORMS
Recommended Filtering for the Analog and Digital Power Supplies (AVDD and VDDQ)
NOTES:
Place all decoupling capacitors as close to the CSPU877A pins as possible.
Use wide traces for AVDD and AGND.
Recommended bead: Fair-rite P/N 2506036017Y0 or equivalent (0.8
Ω DC max., 600Ω at 100MHz).
Clock Inputs and
Outputs, OE
80%
20%
VID,VOD
tR(I), tR(O)
80%
20%
V20%
V80%
tSLF(I/O) =
tF(I/O)
tF(I), tF(O)
V20%
V80%
tSLR(I/O) =
tR(I/O)
VDDQ
GND
VIA
CARD
VIA
CARD
BEAD
0603
4.7uF
1206
0.1uF
0603
2200pF
0603
AVDD
AGND
VDDQ
GND
CSPU877A
1
Ω
1
0.1uF
0603
10
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PDF描述
IDTCSPU877NLG CSPU877 SERIES, PLL BASED CLOCK DRIVER, 10 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PQCC40
IDTCSPU877NL8 CSPU877 SERIES, PLL BASED CLOCK DRIVER, 10 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PQCC40
IDTCSPUA877BVG CSPUA877 SERIES, PLL BASED CLOCK DRIVER, 10 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), BGA52
IDTCV105EPVG 200 MHz, PROC SPECIFIC CLOCK GENERATOR, PDSO48
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參數描述
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IDTCSPU877D 制造商:IDT 制造商全稱:Integrated Device Technology 功能描述:1.8V PHASE LOCKED LOOP DIFFERENTIAL 1:10 SDRAM CLOCK DRIVER
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