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參數(shù)資料
| 型號： | IDT82V3012PV |
| 廠商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分類： | 通信及網(wǎng)絡(luò) |
| 英文描述： | T1/E1/OC3 WAN PLL WITH DUAL REFERENCE INPUTS |
| 中文描述： | SPECIALTY TELECOM CIRCUIT, PDSO56 |
| 封裝： | SSOP-56 |
| 文件頁數(shù)： | 104/375頁 |
| 文件大?。?/td> | 2430K |
| 代理商： | IDT82V3012PV |
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IDT82P2281
SINGLE T1/E1/J1 LONG HAUL / SHORT HAUL TRANSCEIVER
Operation
93
October 7, 2003
4
OPERATION
4.1
POWER-ON SEQUENCE
To power on the device, the following sequence should be followed:
1. Apply ground;
2. Apply 3.3 V;
3. Apply 1.8 V.
4.2
RESET
When the device is powered-up, all the registers contain random
values.
The hardware reset pin
RESET
must be asserted low during the
power-up and the low signal should last at least 10 ms to initialize the
device. After the
RESET
pin is asserted high, all the registers are in their
default values and can be accessed after 2 ms (refer to Figure 35).
During normal operation, the device can be reset by hardware or
software anytime. When it is hardware reset, the
RESET
pin should be
asserted low for at least 100 ns. Then all the registers are in their default
values and can be accessed after 2 ms (refer to Figure 36). When it is
software reset, a write signal to the Software Reset register will reset all
the registers except the T1/J1 Or E1 Mode register to their default val-
ues. Then the registers are accessible after 2 ms. However, the T1/J1
Or E1 Mode register can not be reset by the software reset. It can only
be reset by the hardware reset.
Hardware or software reset can only be applied when the clock on
the OSCI pin is available.
It should be mentioned that when the setting in the T1/J1 Or E1
Mode register is changed, a software reset must be applied.
Figure 35. Hardware Reset When Powered-Up
Figure 36. Hardware Reset In Normal Operation
4.3
RECEIVE / TRANSMIT PATH POWER DOWN
The receive path can be power down by setting the R_OFF bit.
During the receive path power down, the output is low.
The transmit path can be set to power down by the T_OFF bit. Dur-
ing the transmit path power down, the output is High-Z.
Vdd
RESET
Microprocessor
Interface
10ms
2ms
access
RESET
Microprocessor
Interface
2ms
access
100 ns
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| IDT82V3155 | ENHANCED T1/E1/OC3 WAN PLL WITH DUAL REFERENCE INPUTS |
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| IDT82V3012PVG8 | 功能描述:IC PLL WAN T1/E1/OC3 DUAL 56SSOP RoHS:是 類別:集成電路 (IC) >> 時鐘/計時 - 專用 系列:- 標(biāo)準(zhǔn)包裝:1,500 系列:- 類型:時鐘緩沖器/驅(qū)動器 PLL:是 主要目的:- 輸入:- 輸出:- 電路數(shù):- 比率 - 輸入:輸出:- 差分 - 輸入:輸出:- 頻率 - 最大:- 電源電壓:3.3V 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:28-SSOP（0.209"，5.30mm 寬） 供應(yīng)商設(shè)備封裝:28-SSOP 包裝:帶卷 (TR) 其它名稱:93786AFT |
| IDT82V3155 | 制造商:IDT 制造商全稱:Integrated Device Technology 功能描述:ENHANCED T1/E1/OC3 WAN PLL WITH DUAL REFERENCE INPUTS |
| IDT82V3155PV | 制造商:IDT 制造商全稱:Integrated Device Technology 功能描述:ENHANCED T1/E1/OC3 WAN PLL WITH DUAL REFERENCE INPUTS |
| IDT82V3155PVG | 功能描述:IC PLL WAN T1/E1/OC3 DUAL 56SSOP RoHS:是 類別:集成電路 (IC) >> 時鐘/計時 - 專用 系列:- 標(biāo)準(zhǔn)包裝:1,500 系列:- 類型:時鐘緩沖器/驅(qū)動器 PLL:是 主要目的:- 輸入:- 輸出:- 電路數(shù):- 比率 - 輸入:輸出:- 差分 - 輸入:輸出:- 頻率 - 最大:- 電源電壓:3.3V 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:28-SSOP（0.209"，5.30mm 寬） 供應(yīng)商設(shè)備封裝:28-SSOP 包裝:帶卷 (TR) 其它名稱:93786AFT |
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