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參數(shù)資料
| 型號： | IDT82V2058 |
| 廠商： | Integrated Device Technology, Inc. |
| 英文描述： | OCTAL E1 SHORT HAUL LINE INTERFACE UNIT |
| 中文描述： | 八路素E1短途線路接口單元 |
| 文件頁數(shù)： | 55/375頁 |
| 文件大?。?/td> | 2430K |
| 代理商： | IDT82V2058 |
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IDT82P2281
SINGLE T1/E1/J1 LONG HAUL / SHORT HAUL TRANSCEIVER
Functional Description
44
October 7, 2003
- The data between the opening flag and the closing flag is less
than 5 bytes (including the FCS, excluding the flags);
- The extracted HDLC packet does not consist of an integral num-
ber of octets;
- A 7F (Hex) abort sequence is received;
- Address is not matched if the address comparison is enabled.
(The address comparison mode is selected by the ADRM[1:0] bits. If
high byte address comparison is required, the high byte address posi-
tion (the byte following the opening flag) is compared with the value in
the HA[7:0] bits, or with ‘0xFC’ or ‘0xFE’. Here the ‘C/R’ bit position is
excluded to compare. If low byte address comparison is required, the
high byte address position is compared with the value in the LA[7:0] bits.
Here the ‘C/R’ bit position is included to compare. If both bytes address
comparison is required, the high byte address position is compared with
the value in the HA[7:0] bits, or with ‘0xFC’ or ‘0xFE’. Here the ‘C/R’ bit
position is excluded to compare. And the low byte position (the byte fol-
lowing the high byte address position) is compared with the value in the
LA[7:0] bits.
If any of the above conditions is detected, the current block will be
discarded, but the one-byte overhead will still be written into the FIFO.
The overhead consists of the M[2:0] bits and the length indication bits as
shown in Figure 13.
Figure 13. Overhead Indication In The FIFO
The FIFO depth is 128 bytes. The FIFO is accessed by the
DAT[7:0] bits. When the overhead is read from the FIFO, it will be indi-
cated by the PACK bit. When all valid HDLC blocks are pushed into the
FIFO or all the blocks are read from the FIFO, it will be indicated by the
EMP bit.
The interrupt sources in this block are summarized in Table 30.
When there are conditions meeting the interrupt sources, the corre-
sponding Interrupt Indication bit will be set to ‘1’ and the Interrupt Indica-
tion bit will be cleared by writing a ‘1’. A ‘1’ in the Interrupt Indication bit
means there is an interrupt. The interrupt will be reported by the
INT
pin
if its Interrupt Enable bit is ‘1’.
The HDLC Receiver will be reset when there is a transition from ‘0’
to ‘1’ on the RRST bit. The reset will clear the FIFO, the PACK bit and
the EMP bit.
overhead (one byte)
bit 7
bit 0
M2
M1
M0
Length Indication
M[2:0]:
= 000: A valid short HDLC/SS7 packet is received, i.e., the data stream between the opening flag and the FCS is less than 32 bytes (including
32 bytes).
= 001: The current block is not the last block of the HDLC/SS7 packet.
= 010: The current block is the last block of a valid long (more than 32 bytes) HDLC/SS7 packet.
= 011: Reserved.
= 100: An invalid short HDLC/SS7 packet is received and the current block is discarded.
= 101: The current block is the last block of an invalid long HDLC/SS7 packet and the block is discarded.
= 110: Reserved.
= 111: Reserved.
The Length Indication is valid when the M2 bit is zero: Length Indication = N - 1 (N is the number of byte).
Otherwise, the Length Indication is zero.
Table 30: Interrupt Summarize In HDLC Mode
Sources
Interrupt Indication Bit Interrupt Enable Bit
A block is pushed into the FIFO.
Data is still attempted to write
into the FIFO when the FIFO
has been already full (128
bytes).
RMBEI
OVFLI
RMBEE
OVFLE
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