參數(shù)資料
型號： IDT82V2048DA
廠商： INTEGRATED DEVICE TECHNOLOGY INC
元件分類： 數(shù)字傳輸電路
英文描述： OCTAL T1/E1 SHORT HAUL LINE INTERFACE UNIT
中文描述： DATACOM, PCM TRANSCEIVER, PQFP144
封裝： TQFP-144
文件頁數(shù)： 131/375頁
文件大小： 2430K
代理商： IDT82V2048DA
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IDT82P2281
SINGLE T1/E1/J1 LONG HAUL / SHORT HAUL TRANSCEIVER
Programming Information
120
October 7, 2003
T1/J1 Transmit Configuration 4
(026H)
WDAT[6:0]:
These bits contain the data to be stored in the pulse template RAM which is addressed by the UI[1:0] bits (b5~4, T1/J1-025H) and the SAMP[3:0]
bits (b3~0, T1/J1-025H).
T1/J1 Receive Jitter Attenuation Configuration
(027H)
RJITT_TEST:
= 0: The real time interval between the read and write pointer of the FIFO is indicated in the RJITT[6:0] bits (b6~0, T1/J1-039H). That is, the cur-
rent interval between the read and write pointer of the FIFO will be written into the RJITT[6:0] bits (b6~0, T1/J1-039H).
= 1: The peak-peak interval between the read and write pointer of the FIFO is indicated in the RJITT[6:0] bits (b6~0, T1/J1-039H). That is, the
current interval is compared with the old one in the RJITT[6:0] bits (b6~0, T1/J1-039H) and the larger one will be indicated by the RJITT[6:0] bits
(b6~0, T1/J1-039H); otherwise, the value in the RJITT[6:0] bits (b6~0, T1/J1-039H) will not be changed.
RJA_LIMT:
When the read and write pointer of the FIFO are within 2/3/4 bits (corresponding to the FIFO depth) of overflowing or underflowing, the bandwidth
of the JA can be widened to track the short term input jitter, thereby avoiding data corruption. This bit selects whether the bandwidth is normal or wid-
ened.
= 0: Normal bandwidth is selected.
= 1: Widen bandwidth is selected. In this case, the JA will not attenuate the input jitter until the read/write pointer’s position is outside the 2/3/4
bits window.
RJA_E:
= 0: Disable the Receive Jitter Attenuator.
= 1: Enable the Receive Jitter Attenuator.
RJA_DP[1:0]:
These two bits select the Jitter Attenuation Depth.
= 00: The Jitter Attenuation Depth is 128-bit.
= 01: The Jitter Attenuation Depth is 64-bit.
= 10 / 11: The Jitter Attenuation Depth is 32-bit.
RJA_BW:
This bit select the Jitter Transfer Function Bandwidth.
= 0: 5 Hz.
= 1: 1.26 Hz.
Bit No.
7
6
5
4
3
2
1
0
Bit Name
Reserved
WDAT6
WDAT5
WDAT4
WDAT3
WDAT2
WDAT1
WDAT0
Type
R/W
R/W
R/W
R/W
R/W
R/W
R/W
Default
0
0
0
0
0
0
0
Bit No.
7
6
5
4
3
2
1
0
Bit Name
Reserved
RJITT_TEST
RJA_LIMT
RJA_E
RJA_DP1
RJA_DP0
RJA_BW
Type
R/W
R/W
R/W
R/W
R/W
R/W
Default
0
0
0
0
0
0
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PDF描述
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參數(shù)描述
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IDT82V2048EBBG 功能描述:IC LINE INTERFACE UNIT 208-PBGA RoHS:是 類別:集成電路 (IC) >> 接口 - 驅(qū)動器，接收器，收發(fā)器 系列:- 標準包裝:2,500 系列:- 類型:驅(qū)動器 驅(qū)動器/接收器數(shù):4/0 規(guī)程:RS422 電源電壓:4.5 V ~ 5.5 V 安裝類型:表面貼裝 封裝/外殼:16-SOIC（0.154"，3.90mm 寬） 供應商設(shè)備封裝:16-SOIC N 包裝:帶卷 (TR)
IDT82V2048EDR 功能描述:IC LIU T1/E1 8CH SHORT 208-TQFP RoHS:否 類別:集成電路 (IC) >> 接口 - 驅(qū)動器，接收器，收發(fā)器 系列:- 標準包裝:250 系列:- 類型:收發(fā)器 驅(qū)動器/接收器數(shù):2/2 規(guī)程:RS232 電源電壓:3 V ~ 5.5 V 安裝類型:表面貼裝 封裝/外殼:16-TSSOP（0.173"，4.40mm 寬） 供應商設(shè)備封裝:16-TSSOP 包裝:帶卷 (TR)
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