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參數(shù)資料
| 型號(hào)： | IDT82V2048BBG |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 44/62頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC LIU T1/E1 8CH SHORT 160-BGA |
| 標(biāo)準(zhǔn)包裝： | 14 |
| 類型： | 線路接口裝置（LIU） |
| 規(guī)程： | E1 |
| 電源電壓： | 3.13 V ~ 3.47 V |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 160-BGA |
| 供應(yīng)商設(shè)備封裝： | 160-PBGA（15x15） |
| 包裝： | 托盤 |
| 其它名稱： | 82V2048BBG |
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49
IDT82V2048 OCTAL T1/E1 SHORT HAUL LINE INTERFACE UNIT
INDUSTRIAL TEMPERATURE RANGES
RECEIVER CHARACTERISTICS
Symbol
Parameter
Min
Typ
Max
Unit
ATT
Permissible Cable Attenuation (E1: @ 1024 kHz, T1: @ 772 kHz)
15
dB
IA
Input Amplitude
0.1
0.9
Vp
SIR
Signal to Interference Ratio Margin(1)
1. E1: per G.703, O.151 @ 6 dB cable attenuation. T1: @ 655 ft. of 22 ABAM cable
-15
dB
SRE
Data Decision Threshold (refer to peak input voltage)
50
%
Data Slicer Threshold
150
mV
Analog Loss Of Signal(2)
Declare/Clear:
2. Measured on device, between RTIP and RRING, all ones signal.
120/150
200/250
280/350
mVp
Allowable consecutive zeros before LOS
E1, G.775:
E1, ETSI 300 233:
T1, T1.231-1993
32
2048
175
LOS Reset
Clock Recovery Mode
12.5
% ones
JRXp-p
Peak to Peak Intrinsic Receive Jitter (JA disabled)
E1 (wide band):
T1 (wide band):
0.0625
U.I.
JTRX
Jitter Tolerance
E1: 1 Hz – 20 Hz
20 Hz – 2.4 kHz
18 kHz – 100 kHz
18.0
1.5
0.2
U.I.
T1: 0.1 Hz – 1 Hz
4.9 Hz – 300 Hz
10 kHz – 100 kHz
138.0
28.0
0.4
U.I.
ZDM
Receiver Differential Input Impedance
120
k
ZCM
Receiver Common Mode Input Impedance to GND
10
k
RRX
Receive Return Loss
51 kHz – 102 kHz
102 kHz – 2.048 MHz
2.048 MHz – 3.072 MHz
20
dB
Receive Path Delay
Dual Rail
Single Rail
3
8
U.I.
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PDF描述 |
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參數(shù)描述 |
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| IDT82V2048EBBG | 功能描述:IC LINE INTERFACE UNIT 208-PBGA RoHS:是 類別:集成電路 (IC) >> 接口 - 驅(qū)動(dòng)器，接收器，收發(fā)器 系列:- 標(biāo)準(zhǔn)包裝:2,500 系列:- 類型:驅(qū)動(dòng)器 驅(qū)動(dòng)器/接收器數(shù):4/0 規(guī)程:RS422 電源電壓:4.5 V ~ 5.5 V 安裝類型:表面貼裝 封裝/外殼:16-SOIC（0.154"，3.90mm 寬） 供應(yīng)商設(shè)備封裝:16-SOIC N 包裝:帶卷 (TR) |
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