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參數(shù)資料
| 型號： | IDT79RC32V333-150DHG |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 11/30頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC PROC 32BIT CPU 150MHZ 208-QFP |
| 產(chǎn)品變化通告： | Product Discontinuation 07/Dec/2009 |
| 標準包裝： | 24 |
| 系列： | Interprise™ |
| 處理器類型： | RISC 32-位 |
| 速度： | 150MHz |
| 電壓： | 3.3V |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 208-BFQFP |
| 供應商設(shè)備封裝： | 208-PQFP（28x28） |
| 包裝： | 托盤 |
| 其它名稱： | 79RC32V333-150DHG |
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May 4, 2004
IDT 79RC32333
Standard EJTAG Timing
— RC32333
Figure 4 represents the timing diagram for the EJTAG interface signals.
The standard JTAG connector is a 10-pin connector providing 5 signals and 5 ground pins. For Standard EJTAG, a 24-pin connector has been
chosen providing 12 signals and 12 ground pins. This guarantees elimination of noise problems by incorporating signal-ground type arrangement.
Refer to the RC3233x User Reference Manual for connector pinout and mechanical specifications.
Figure 4 Standard EJTAG Timing
jtag_tdi/ejtag_dint_n
ejtag_tms, jtag_tms
jtag_tdo/ejtag_tpc,
ejtag_tpc[8:2]
jtag_tdo
ejtag_tpc
ejtag_pcst[2:0]
jtag_trst_n
jtag_tck
ejtag_dclk
ejtag_pcst
t3
t14
t1
t2
t15
t9
t10
t5
t6
t4
t8
t7
t13
t12
t11
ejtag_tpc,ejtag_pcst[2:0] capture
Notes to diagram:
t1 = tTCKlow
t2 = tTCKHIGH
t3 = tTCK
t4 = tTDODO
t5 = tTDIS
t6 = tTDIH
t7 = tPCSTDO
t8 = tTPCDO
t9 = tDCKHIGH
t10 = tDCKLOW
t11 = tDCK
t12 = tTRSTDO
t13 = tTRSTR
t14 = tTCK RISE, tTCK FALL
t15 = tDCK RISE, tDCK FALL
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