參數(shù)資料
型號(hào)： IDT79RC32H434-266BCG
廠商： IDT, Integrated Device Technology Inc
文件頁數(shù)： 15/53頁
文件大小： 0K
描述： IC MPU 32BIT CORE 266MHZ 256-BGA
標(biāo)準(zhǔn)包裝： 90
系列： Interprise™
處理器類型： MIPS32 32-位
速度： 266MHz
電壓： 1.2V
安裝類型： 表面貼裝
封裝/外殼： 256-LBGA
供應(yīng)商設(shè)備封裝： 256-CABGA（17x17）
包裝： 托盤
其它名稱： 79RC32H434-266BCG
22 of 53
January 19, 2006
IDT RC32434
MDATA[7:0]
Tsu_8c
EXTCLK rising
6.0
—
6.0
—
6.0
—
6.0
—
ns
See Figures 8
and 9 (cont.).
Thld_8c
0
—
0
—
0
—
0
—
ns
Tdo_8c
0.4
4.5
0.4
4.5
0.4
4.5
0.4
4.5
ns
Tdz_8c2
00.500.500.500.5
ns
Tzd_8c2
0.4
3.3
0.4
3.3
0.4
3.3
0.4
3.3
ns
EXTCLK3
Tper_8d
none
7.5
—
6.66
—
6.66
—
6.66
—
ns
BDIRN
Tdo_8e
EXTCLK rising
0.4
3.8
0.4
3.8
0.4
3.8
0.4
3.8
ns
Tdz_8e2
——
———
ns
Tzd_8e2
——
———
ns
BOEN
Tdo_8f
EXTCLK rising
0.4
3.8
0.4
3.8
0.4
3.8
0.4
3.8
ns
Tdz_8f2
——
———
ns
Tzd_8f2
——
———
ns
WAITACKN4
Tsu_8h
EXTCLK rising
6.5
—
6.5
—
6.5
—
6.5
—
ns
Thld_8h
0
—0—0—
0
—
ns
Tpw_8h2
none
2(EXTCLK)
—
2(EXTCLK)
—
2(EXTCLK)
—
2(EXTCLK)
—ns
CSN[3:0]
Tdo_8i
EXTCLK rising
0.4
4.0
0.4
4.0
0.4
4.0
0.4
4.0
ns
Tdz_8i2
——
———
ns
Tzd_8i2
——
———
ns
RWN
Tdo_8j
EXTCLK rising
0.4
3.8
0.4
3.8
0.4
3.8
0.4
3.8
ns
Tdz_8j2
——
———
ns
Tzd_8j2
——
———
ns
OEN
Tdo_8k
EXTCLK rising
0.4
4.0
0.4
4.0
0.4
4.0
0.4
4.0
ns
Tdz_8k2
——
———
ns
Tzd_8k2
——
———
ns
WEN
Tdo_8l
EXTCLK rising
0.4
3.7
0.4
3.7
0.4
3.7
0.4
3.7
ns
Tdz_8l2
——
———
ns
Tzd_8l2
——
———
ns
1. The RC32434 provides bus turnaround cycles to prevent bus contention when going from read to write, write to read, and during external bus ownership. For example, there are no
cycles where an external device and the RC32434 are both driving. See Chapter 6, Device Controller, in the RC32434 User Reference Manual.
2. The values for this symbol were determined by calculation, not by testing.
3. The frequency of EXTCLK is programmable. See the External Clock Divider (MDATA[5:4]) description in Table 3 of this data sheet.
4. WAITACKN must meet the setup and hold times if it is synchronous or the minimum pulse width if it is asynchronous.
Signal
Symbol Reference
Edge
266MHz
300MHz
350MHz
400MHz
Unit
Condi-
tions
Timing
Diagram
Reference
Min
Max
Min
Max
Min
Max
Min
Max
Table 8 Memory and Peripheral Bus AC Timing Characteristics (Part 2 of 2)
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PDF描述
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參數(shù)描述
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