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參數(shù)資料
| 型號： | IDT77305 |
| 廠商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分類： | DRAM |
| 英文描述： | UTOPIAFIFO 4 PORT MULTIPLEXER FIFO |
| 中文描述： | 128 X 9 OTHER FIFO, 8.5 ns, PQFP100 |
| 封裝： | 14 X 14 MM, 1.40 MM HEIGHT, TQFP-100 |
| 文件頁數(shù)： | 1/27頁 |
| 文件大?。?/td> | 248K |
| 代理商： | IDT77305 |
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2001 Integrated Device Technology, Inc.
1
DSC-3206/3
N
Four Independent Input 128 x9 FIFO Queues
N
Nine bit wide input FIFOs
N
Single selectable 9 or 18 bit output bus
N
"UtopiaRx" or "UtopiaTx" Utopia compliant interface signaling
options
N
Separate clocks for input and output
N
Selectable Automatic byte insertion for 8-bit Receive Utopia to 16-
bit Receive Utopia compliance
N
Four 155Mbs ATMinput channels can be consolidated into a
single 622Mbs channel with no additional glue logic
N
Maximumthrough put per device over 1.4Gbps
N
In a building block configuration multiple input channels can
be multiplexed onto a 32, 64 or 128 bit bus.
N
User programmable:
– byte insert/delete, UtopiaTx/UtopiaRx mode, master/slave
configuration, byte swapping
N
Selectable Round Robin Sequencer output control
N
Data clock rates to 80 MHz; access times 8.5 ns
N
100-pin TQPF package
N
Separate cell ready signals for each FIFO and cell ready
composite signal
N
End of cell transfer flag
FIFO CONTROLLER
128 BYTES
FIFO
FIFO CONTROLLER
128 BYTES
FIFO
FIFO CONTROLLER
128 BYTES
FIFO
FIFO CONTROLLER
128 BYTES
FIFO
a
CLAVR a
SOCR a
Data a
b
CLAVR b
SOCR b
Data b
c
CLAVR c
SOCR c
Data c
d
CLAVR d
SOCR d
Data d
RTS
BDI
WCLK
CELL SIZE/CELL READY
ROUND
ROBIN
SEQUENCER
MSE
RRE
RCLK
MUX1
MUX2
LDM
SWP
CLAVS
SOCS
Q
0
- Q
8
Q
9
- Q
17
X 18
BSS
3206 drw 01
CRn
CRC
ECT
CSS
(0 - 8)
(0 - 8)
(0 - 8)
(0 - 8)
,
!"#$%&%!'
(()%)"
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PDF描述 |
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參數(shù)描述 |
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