參數(shù)資料
型號(hào)： IDT74SSTUBF32865ABK8
廠商： IDT, Integrated Device Technology Inc
文件頁(yè)數(shù)： 13/16頁(yè)
文件大?。?/td> 0K
描述： IC BUFFER 28BIT 1:2 REG 160-BGA
產(chǎn)品變化通告： Product Discontinuation 09/Dec/2011
標(biāo)準(zhǔn)包裝： 1,000
邏輯類型： 1:2 寄存緩沖器，帶奇偶位
電源電壓： 1.7 V ~ 1.9 V
位數(shù)： 28
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 160-LFBGA
供應(yīng)商設(shè)備封裝： 160-CABGA（9x13）
包裝： 帶卷 (TR)
其它名稱： 74SSTUBF32865ABK8
IDT74SSTUBF32865A
28-BIT 1:2 REGISTERED BUFFER WITH PARITY
COMMERCIAL TEMPERATURE GRADE
28-BIT 1:2 REGISTERED BUFFER WITH PARITY
6
IDT74SSTUBF32865A
7092/11
Parity and Standby Function Table
Inputs1
Outputs
RESET
DCS0
DCS1
CLK
Σ of Inputs = H (D1 - D21)
PARIN2
PTYERR3
HL
X
↑↓
Even
L
H
HL
X
↑↓
Odd
L
HL
X
↑↓
Even
H
L
HL
X
↑↓
Odd
H
HX
L
↑↓
Even
L
H
HX
L
↑↓
Odd
L
HX
L
↑↓
Even
H
L
HX
L
↑↓
Odd
H
HH
H
↑↓
X
PTYERR0
H
X
L or H
X
PTYERR0
LX or
Floating
X or
Floating
X or
Floating
X or
Floating
X or Floating
H
1
H = HIGH Voltage Level
L = LOW Voltage Level
X = Don’t Care
↑ = LOW to HIGH
↓ = HIGH to LOW
2
PARIN arrives one clock cycle after the data to which it applies.
3
This transition assumes PTYERR is HIGH at the crossing of CLK going HIGH and CLK going LOW. If
PTYERR is LOW, it stays latched LOW for two clock cycles or until RESET is driven LOW.
相關(guān)PDF資料
PDF描述
IDT74SSTUBF32866BBFG IC BUFFER 25BIT REG DDR2 96-BGA
IDT74SSTUBF32868ABKG IC BUFFR 28BIT REG DDR2 176-BGA
IDT74SSTUBF32869ABKG IC BUFFER 14BIT REG DDR2 150-BGA
IDT74SSTUBH32865ABKG8 IC BUFFER 28BIT 1:2 REG 160-BGA
IDT74SSTUBH32868ABKG IC BUFFER 28BIT CONF DDR2 176BGA
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參數(shù)描述
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