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參數(shù)資料
| 型號(hào)： | IDT74SSTU32864CBF8 |
| 廠商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分類(lèi)： | 鎖存器 |
| 英文描述： | SSTU SERIES, POSITIVE EDGE TRIGGERED D FLIP-FLOP, TRUE OUTPUT, PBGA96 |
| 封裝： | LFBGA-96 |
| 文件頁(yè)數(shù)： | 11/12頁(yè) |
| 文件大?。?/td> | 166K |
| 代理商： | IDT74SSTU32864CBF8 |
8
COMMERCIALTEMPERATURERANGE
IDT74SSTU32864/A/C/D/G
1:1 AND 1:2 REGISTERED BUFFER WITH 1.8V SSTL I/O
OPERATING CHARACTERISTICS, TA = 25C (1,2)
Symbol
Parameter
Min.
Typ.
Max.
Unit
VDD
Supply Voltage
1.7
—
1.9
V
VREF
ReferenceVoltage
0.49 * VDD
0.5 * VDD
0.51 * VDD
V
VTT
TerminationVoltage
VREF– 40mV
VREF
VREF+ 40mV
V
VI
InputVoltage
0
—
VDD
V
VIH
AC High-Level Input Voltage
DataInputs
VREF+ 250mV
—
V
VIL
AC Low-Level Input Voltage
DataInputs
—
VREF– 250mV
V
VIH
DC High-Level Input Voltage
DataInputs
VREF+ 125mV
—
V
VIL
DC Low-Level Input Voltage
DataInputs
—
VREF– 125mV
V
VIH
High-Level Input Voltage
RESET, Cx
0.65 * VDD
——
V
VIL
Low-Level Input Voltage
RESET, Cx
—
0.35 * VDD
V
VICR
Common Mode Input Voltage
CLK,
CLK
0.675
—
1.125
V
VID
DifferentialInputVoltage
CLK,
CLK
600
—
mV
IOH
High-Level Output Current
—
–8
mA
IOL
Low-Level Output Current
—
8
TA
OperatingFree-AirTemperature
0
—
70
° C
NOTES:
1. The
RESET and Cx inputs of the device must be held at valid levels (not floating) to ensure proper device operation.
2. The differential inputs must not be floating unless
RESET is LOW.
Symbol
Parameter
Test Conditions
Min.
Typ.
Max.
Unit
VOH
VDD = 1.7V to 1.9V, IOH = –6mA
1.2
—
V
VOL
VDD = 1.7V to 1.9V, IOL = 6mA
—
0.5
V
II
All Inputs
VI = VDD or GND
–5
—
5
μA
IDD
Static Standby
IO = 0, VDD = 1.9V,
RESET = GND
—
100
μA
StaticOperating
IO = 0, VDD = 1.9V,
RESET = VDD, VI = VIH (AC) or VIL (AC)
——
40
mA
IDDD
Dynamic Operating
IO = 0, VDD = 1.8V,
RESET = VDD, VI = VIH (AC) or VIL (AC),—
—
μA/Clock
(Clock Only)
CLK and
CLK Switching 50% Duty Cycle.
MHz
IO = 0, VDD = 1.8V,
RESET = VDD,
1:1 Mode
—
Dynamic Operating
VI = VIH (AC) or VIL (AC), CLK and
CLK Switching at
μA/Clock
(Per Each Data Input)
50% Duty Cycle. One Data Input Switching at
1:2 Mode
—
MHz/Data
Half Clock Frequency, 50% Duty Cycle.
Input
DataInputs
VI = VREF
± 250mV
2.5
—
3.5
CI
CLK and
CLK
VICR = 0.9V, VID = 600mV
2
—
3
pF
RESET
VI = VDD or GND
2
—
4
DC ELECTRICAL CHARACTERISTICS OVER OPERATING RANGE
Following Conditions Apply Unless Otherwise Specified:
Operating Condition: TA = 0°C to +70°C, VDD = 1.8V ±0.1V
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