ST-BUS
參數(shù)資料
型號(hào)： IDT72V70810PF
廠商： IDT, Integrated Device Technology Inc
文件頁(yè)數(shù)： 4/22頁(yè)
文件大?。?/td> 0K
描述： IC DGTL SW 1024X1024 3.3V 64TQFP
標(biāo)準(zhǔn)包裝： 45
系列： 72V
類(lèi)型： 多路復(fù)用器
電路： 1 x 8:8
獨(dú)立電路： 1
電壓電源： 單電源
電源電壓： 3 V ~ 3.6 V
工作溫度： -40°C ~ 85°C
安裝類(lèi)型： 表面貼裝
封裝/外殼： 64-LQFP
供應(yīng)商設(shè)備封裝： 64-TQFP（14x14）
包裝： 托盤(pán)
其它名稱： 72V70810PF
12
COMMERCIALTEMPERATURERANGE
IDT72V70810 3.3V TIME SLOT INTERCHANGE
DIGITAL SWITCH 1,024 x 1,024
ST-BUS
F0i
RX Stream
5710 drw05
Bit 7
CLK
Bit 7
denotes the 3/4 point of the bit cell
offset = 0, DLE = 0
offset = 1, DLE = 0
offset = 0, DLE = 1
offset = 1, DLE = 1
GCI
F0i
Bit 0
CLK
Bit 0
denotes the 3/4 point of the bit cell
offset = 0, DLE = 0
offset = 1, DLE = 0
offset = 0, DLE = 1
offset = 1, DLE = 1
RX Stream
TABLE 9 — OFFSET BITS (OFN2, OFN1, OFN0, DLEN) & FRAME DELAY BITS
(FD11, FD2-0)
Figure 5. Examples for Input Offset Delay Timing
MeasurementResultfrom
Corresponding
InputStream
Frame Delay Bits
OffsetBits
Offset
FD11
FD2
FD1
FD0
OFn2
OFn1
OFn0
DLEn
No clock period shift (Default)
1000000
0
+ 0.5 clock period shift
0000000
1
+ 1.0 clock period shift
1001001
0
+ 1.5 clock period shift
0001001
1
+ 2.0 clock period shift
1010010
0
+ 2.5 clock period shift
0010010
1
+ 3.0 clock period shift
1011011
0
+ 3.5 clock period shift
0011011
1
+ 4.0 clock period shift
1100100
0
+ 4.5 clock period shift
0100100
1
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PDF描述
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參數(shù)描述
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