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參數資料
| 型號： | IDT72V3690L6PF |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數： | 15/46頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC FIFO SS 32768X36 6NS 128-TQFP |
| 標準包裝： | 8 |
| 系列： | 72V |
| 功能： | 異步，同步 |
| 存儲容量： | 1.1M（32K x 36） |
| 數據速率： | 166MHz |
| 訪問時間： | 4ns |
| 電源電壓： | 3.15 V ~ 3.45 V |
| 工作溫度： | 0°C ~ 70°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 128-LQFP |
| 供應商設備封裝： | 128-TQFP（14x20） |
| 包裝： | 托盤 |
| 其它名稱： | 72V3690L6PF |
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22
COMMERCIAL AND INDUSTRIAL
TEMPERATURE RANGES
IDT72V3640/50/60/70/80/90 3.3V HIGH DENSITY SUPERSYNC IITM 36-BIT FIFO
1,024 x 36, 2,048 x 36, 4,096 x 36, 8,192 x 36, 16,384 x 36 and 32,768 x 36
OCTOBER 22, 2008
If asynchronous
PAEconfigurationisselected,the PAEisassertedLOW
ontheLOW-to-HIGHtransitionoftheReadClock(RCLK).
PAEisresettoHIGH
ontheLOW-to-HIGHtransitionoftheWriteClock(WCLK). Ifsynchronous
PAE
configuration is selected, the
PAEisupdatedontherisingedgeofRCLK. See
Figure 21, Asynchronous Programmable Almost-Empty Flag Timing (IDT
Standard and FWFT Mode).
HALF-FULL FLAG (
HF )
Thisoutputindicatesahalf-fullFIFO.TherisingWCLKedgethatfillstheFIFO
beyondhalf-fullsets
HFLOW.TheflagremainsLOWuntilthedifferencebetween
the write and read pointers becomes less than or equal to half of the total depth
of the device; the rising RCLK edge that accomplishes this condition sets
HF
HIGH.
InIDTStandardmode,ifnoreadsareperformedafterreset(
MRSorPRS),
HF will go LOW after (D/2 + 1) writes to the FIFO, where D = 1,024 for the
IDT72V3640, 2,048 for the IDT72V3650, 4,096 for the IDT72V3660, 8,192
fortheIDT72V3670,16,384fortheIDT72V3680and32,768fortheIDT72V3690.
In FWFT mode, if no reads are performed after reset (
MRS or PRS), HF
will go LOW after (D-1/2 + 2) writes to the FIFO, where D = 1,025 for the
IDT72V3640, 2,049 for the IDT72V3650, 4,097 for the IDT72V3660, 8,193 for
the IDT72V3670, 16,385 for the IDT72V3680 and 32,769 for the IDT72V3690.
See Figure 22, Half-Full Flag Timing (IDT Standard and FWFT Modes),
for the relevant timing information. Because
HFisupdatedbybothRCLKand
WCLK, it is considered asynchronous.
DATA OUTPUTS (Q0-Qn)
(Q0-Q35) are data outputs for 36-bit wide data, (Q0 - Q17) are data outputs
for 18-bit wide data or (Q0-Q8) are data outputs for 9-bit wide data.
相關PDF資料 |
PDF描述 |
|---|---|
| IDT72V70180PFG | IC DGTL SW 128X128 3.3V 64-TQFP |
| IDT72V70190PFG | IC DGTL SW 256X256 3.3V 64-TQFP |
| IDT72V70200PFG | IC DGTL SW 512X512 3.3V 100-TQFP |
| IDT72V70210DAG | IC DGTL SW 1024X1024 144-TQFP |
| IDT72V70800PFG | IC DGTL SW 512X512 3.3V 64-TQFP |
相關代理商/技術參數 |
參數描述 |
|---|---|
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| IDT72V3690L6PFG8 | 制造商:Integrated Device Technology Inc 功能描述:IC FIFO SS 32768X36 6NS 128-TQFP |
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| IDT72V3690L7-5BB8 | 功能描述:IC FIFO SS 32768X36 7-5N 144BGA RoHS:否 類別:集成電路 (IC) >> 邏輯 - FIFO 系列:72V 標準包裝:15 系列:74F 功能:異步 存儲容量:256（64 x 4） 數據速率:- 訪問時間:- 電源電壓:4.5 V ~ 5.5 V 工作溫度:0°C ~ 70°C 安裝類型:通孔 封裝/外殼:24-DIP（0.300"，7.62mm） 供應商設備封裝:24-PDIP 包裝:管件 其它名稱:74F433 |
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