IDT72V3640/50/60/70/80/90 3.3V HIGH DENSITY SUPERSYNC IITM
參數(shù)資料
型號: IDT72V3660L7-5BB8
廠商: IDT, Integrated Device Technology Inc
文件頁數(shù): 24/46頁
文件大小: 0K
描述: IC FIFO SS 4096X36 7-5NS 144BGA
標準包裝: 1,000
系列: 72V
功能: 異步,同步
存儲容量: 147K(4K x 36)
數(shù)據(jù)速率: 133MHz
訪問時間: 5ns
電源電壓: 3.15 V ~ 3.45 V
工作溫度: 0°C ~ 70°C
安裝類型: 表面貼裝
封裝/外殼: 144-BGA
供應商設備封裝: 144-PBGA(13x13)
包裝: 帶卷 (TR)
其它名稱: 72V3660L7-5BB8
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COMMERCIAL AND INDUSTRIAL
TEMPERATURE RANGES
IDT72V3640/50/60/70/80/90 3.3V HIGH DENSITY SUPERSYNC IITM 36-BIT FIFO
1,024 x 36, 2,048 x 36, 4,096 x 36, 8,192 x 36, 16,384 x 36 and 32,768 x 36
OCTOBER 22, 2008
NOTES:
1. Retransmit setup is complete after
EF returns HIGH, only then can a read operation begin.
2.
OE = LOW.
3. W1 = first word written to the FIFO after Master Reset, W2 = second word written to the FIFO after Master Reset.
4. No more than D - 2 may be written to the FIFO between Reset (Master or Partial) and Retransmit setup. Therefore,
FF will be HIGH throughout the Retransmit setup procedure.
D = 1,024 for IDT72V3640, 2,048 for IDT72V3650, 4,096 for IDT72V3660, 8,192 for IDT72V3670, 16,384 for the IDT72V3680 and 32,768 for the IDT72V3690.
5. There must be at least two words written to the FIFO before a Retransmit operation can be invoked.
6. RM is set HIGH during MRS.
Figure 11. Retransmit Timing (IDT Standard Mode)
tREF
tRTS
tENH
4667 drw16
tA
tENS
Wx
WCLK
RCLK
REN
RT
EF
PAF
HF
PAE
Q0 - Qn
tSKEW2
12
1
W1
tPAFS
tHF
tPAES
tREF
Wx+1
2
W2
tENH
WEN
tENS
tRTS
tENS
tENH
(3)
tA
(3)
相關PDF資料
PDF描述
VI-BNF-IV-F3 CONVERTER MOD DC/DC 72V 150W
IDT72V3656L10PF8 IC SYNC FIFO 4096X36 10NS 128QFP
VI-BNF-IV-F2 CONVERTER MOD DC/DC 72V 150W
IDT72V3654L10PF8 IC BI FIFO 4096X36 10NS 128QFP
VI-BNF-IV-F1 CONVERTER MOD DC/DC 72V 150W
相關代理商/技術參數(shù)
參數(shù)描述
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IDT72V3660L7-5PFGI 功能描述:IC FIFO SS 4096X36 7-5NS 128TQFP RoHS:是 類別:集成電路 (IC) >> 邏輯 - FIFO 系列:72V 標準包裝:90 系列:7200 功能:同步 存儲容量:288K(16K x 18) 數(shù)據(jù)速率:100MHz 訪問時間:10ns 電源電壓:4.5 V ~ 5.5 V 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:64-LQFP 供應商設備封裝:64-TQFP(14x14) 包裝:托盤 其它名稱:72271LA10PF
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