IDT72V3623/72V3633/72V3643 CMOS 3.3V SyncBiFIFOTM WITH B" />
參數(shù)資料
型號(hào): IDT72V3623L15PF
廠商: IDT, Integrated Device Technology Inc
文件頁數(shù): 16/28頁
文件大?。?/td> 0K
描述: IC FIFO SYNC 1KX9 15NS 128QFP
標(biāo)準(zhǔn)包裝: 72
系列: 72V
功能: 異步,同步
存儲(chǔ)容量: 9K(1K x 9)
數(shù)據(jù)速率: 67MHz
訪問時(shí)間: 15ns
電源電壓: 3 V ~ 3.6 V
工作溫度: 0°C ~ 70°C
安裝類型: 表面貼裝
封裝/外殼: 128-LQFP
供應(yīng)商設(shè)備封裝: 128-TQFP(14x20)
包裝: 托盤
其它名稱: 72V3623L15PF
23
COMMERCIAL TEMPERATURERANGE
IDT72V3623/72V3633/72V3643 CMOS 3.3V SyncBiFIFOTM WITH BUS-MATCHING
256 x 36, 512 x 36, 1,024 x 36
Figure 13. IR Flag Timing and First Available Write when FIFO is Full (FWFT Mode)
NOTES:
1. tSKEW1 is the minimum time between a rising CLKB edge and a rising CLKA edge for IR to transition HIGH in the next CLKA cycle. If the time between the rising CLKB edge and rising
CLKA edge is less than tSKEW1, then IR may transition HIGH one CLKA cycle later than shown.
2. If Port B size is word or byte, tSKEW1 is referenced to the rising CLKB edge that reads the last word or byte write of the long word, respectively.
CSB
OR
MBB
ENB
B0-B35
CLKB
IR
CLKA
CSA
4662 drw15
W/RA
12
A0-A35
MBA
ENA
tCLK
tCLKH
tCLKL
tENH
tA
tSKEW1
tCLK
tCLKH
tCLKL
tDS
tENH
tDH
To FIFO
Previous Word in FIFO Output Register
Next Word From FIFO
LOW
W/RB
HIGH
LOW
HIGH
LOW
HIGH
(1)
FIFO Full
tWFF
tENS2
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PDF描述
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IDT72V3622L15PQF IC BIFIFO 256X36X2 15NS 132-PQFP
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參數(shù)描述
IDT72V3623L15PF8 功能描述:IC FIFO SYNC 1KX9 15NS 128QFP RoHS:否 類別:集成電路 (IC) >> 邏輯 - FIFO 系列:72V 標(biāo)準(zhǔn)包裝:90 系列:7200 功能:同步 存儲(chǔ)容量:288K(16K x 18) 數(shù)據(jù)速率:100MHz 訪問時(shí)間:10ns 電源電壓:4.5 V ~ 5.5 V 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:64-LQFP 供應(yīng)商設(shè)備封裝:64-TQFP(14x14) 包裝:托盤 其它名稱:72271LA10PF
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IDT72V3624L10PF8 功能描述:IC FIFO 512X36 10NS 128QFP RoHS:否 類別:集成電路 (IC) >> 邏輯 - FIFO 系列:72V 標(biāo)準(zhǔn)包裝:90 系列:7200 功能:同步 存儲(chǔ)容量:288K(16K x 18) 數(shù)據(jù)速率:100MHz 訪問時(shí)間:10ns 電源電壓:4.5 V ~ 5.5 V 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:64-LQFP 供應(yīng)商設(shè)備封裝:64-TQFP(14x14) 包裝:托盤 其它名稱:72271LA10PF
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