Figure 19. Parity Generation Timing wh" />
參數(shù)資料
型號: IDT72V3613L12PQF
廠商: IDT, Integrated Device Technology Inc
文件頁數(shù): 16/25頁
文件大?。?/td> 0K
描述: IC FIFO CLOCK 64X36 12NS 132PQFP
標準包裝: 36
系列: 72V
功能: 同步
存儲容量: 2.3K(64 x 36)
數(shù)據(jù)速率: 83MHz
訪問時間: 12ns
電源電壓: 3 V ~ 3.6 V
工作溫度: 0°C ~ 70°C
安裝類型: 表面貼裝
封裝/外殼: 132-BQFP 緩沖式
供應(yīng)商設(shè)備封裝: 132-PQFP(24.13x24.13)
包裝: 托盤
其它名稱: 72V3613L12PQF
23
IDT72V3613 3.3V, CMOS CLOCKED FIFO WITH
BUS-MATCHING AND BYTE SWAPPING 64 x 36
COMMERCIALTEMPERATURERANGE
Figure 19. Parity Generation Timing when Reading from the Mail1 Register
NOTE:
1. ENA = HIGH.
Figure 18. Parity Generation Timing when Reading from the Mail2 Register
NOTE:
1. ENB = HIGH.
Figure 17. ODD/EVEN
EVEN
EVEN, W/R
RR
RRB, SIZ1, SIZ0, and PGB to PEFB
PEFB
PEFB Timing
NOTE:
1. CSB = LOW and ENB = HIGH.
ODD/
EVEN
PEFB
PGB
SIZ1,
SIZ0
W/
RB
4661 drw 17
Valid
tPOPE
tPEPE
tPOPE
tPEPE
ODD/
EVEN
A8, A17,
A26, A35
PGA
MBA
W/
RA
CSA
4661 drw 18
Mail2 Data
Generated Parity
Mail2 Data
LOW
tEN
tPEPB
tPOPB
tPEPB
ODD/
EVEN
B8, B17,
B26, B35
PGB
SIZ1,
SIZ0
W/
RB
CSB
4661 drw 19
Mail1
Data
Generated Parity
Mail1 Data
LOW
tEN
tPEPB
tPOPB
tPEPB
tMDV
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PDF描述
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IDT72V3613L15PQF 功能描述:IC FIFO CLOCK 64X36 15NS 132PQFP RoHS:否 類別:集成電路 (IC) >> 邏輯 - FIFO 系列:72V 標準包裝:90 系列:7200 功能:同步 存儲容量:288K(16K x 18) 數(shù)據(jù)速率:100MHz 訪問時間:10ns 電源電壓:4.5 V ~ 5.5 V 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:64-LQFP 供應(yīng)商設(shè)備封裝:64-TQFP(14x14) 包裝:托盤 其它名稱:72271LA10PF
IDT72V3613L20PF 功能描述:IC FIFO CLOCK 64X36 20NS 120TQFP RoHS:否 類別:集成電路 (IC) >> 邏輯 - FIFO 系列:72V 標準包裝:90 系列:7200 功能:同步 存儲容量:288K(16K x 18) 數(shù)據(jù)速率:100MHz 訪問時間:10ns 電源電壓:4.5 V ~ 5.5 V 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:64-LQFP 供應(yīng)商設(shè)備封裝:64-TQFP(14x14) 包裝:托盤 其它名稱:72271LA10PF
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