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參數(shù)資料
| 型號： | IDT72T54242 |
| 廠商： | Integrated Device Technology, Inc. |
| 英文描述： | 2.5V QUAD/DUAL TeraSync⑩ DDR/SDR FIFO x10 QUAD FIFO or x10/x20 DUAL FIFO CONFIGURATIONS |
| 中文描述： | 2.5V的四/雙TeraSync⑩復(fù)員/特別提款權(quán)先進(jìn)先出× 10的四雙FIFO或x10/x20先進(jìn)先出配置 |
| 文件頁數(shù)： | 33/56頁 |
| 文件大?。?/td> | 555K |
| 代理商： | IDT72T54242 |
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33
COMMERCIAL AND INDUSTRIAL
TEMPERATURE RANGES
IDT72T54242/72T54252/72T54262 2.5V QUAD/DUAL TeraSync
DDR/SDR FIFO
32K x 10 x 4/16K x 20 x 2, 64K x 10 x 4/32K x 20 x 2 and 128K x 10 x 4/64K x 20 x 2
MARCH 22, 2005
EF
/
OR
(6)
0/1/2/3
t
RSF
If FWFT = HIGH,
OR
= HIGH
If FWFT = LOW,
EF
= LOW
t
RSF
PAF
(6)
0/1/2/3
t
RSF
t
RSF
Q[39:0]
(7)
t
RSF
OE
= HIGH
OE
= LOW
6158 drw15
OW
(3)
,
IW
(3)
FSEL[1:0]
(3)
PFM
(3)
HIGH = Synchronous
PAE
/
PAF
Timing
LOW = Asynchronous
PAE
/
PAF
Timing
MD
(3)
t
RSS
HIGH = FWFT Mode
LOW = IDT Standard Mode
RDDR
(3)
,
WDDR
(3)
FWFT/SI
(3)
IOSEL
(3)
HIGH = Read/Write Double Data Rate
LOW = Read/Write Single Data Rate
HIGH = HSTL I/Os
LOW = LVTTL I/Os
t
RSS
t
RSS
t
RSS
t
RSS
t
RSS
t
RSS
FF
/
IR
(6)
0/1/2/3
PAE
(6)
0/1/2/3
HIGH = Quad mode
LOW = Dual mode
If FWFT = LOW,
FF
= HIGH
If FWFT = HIGH,
IR
= LOW
t
RS
MRS
WEN
0/1/2/3
(6)
REN
0/1/2/3
(6)
t
RSS
SWEN
,
SREN
t
RSS
t
RSR
t
RSR
Figure 10 . Master Reset Timing
NOTES:
1.
OE
can be toggled during master reset. During master reset, the high-impedance control of the Qn data outputs are provided by
OE
only.
2. RCLK(s), WCLK(s) and SCLK(s) can be free running or idle.
3. The state of these pins are latched when the master reset pulse is LOW.
4. JTAG flag should not toggle during master reset.
5.
RCS
and
WCS
can be HIGH or LOW until the first rising edge of RCLK after master reset is complete.
6. If Dual mode is selected, only the signals designated with a "0" or "2" are used.
7. If Dual mode is selected, outputs Q[19:10] and Q[39:30] are not used if outputs are configured to x10.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| IDT72T54242L5BB | 2.5V QUAD/DUAL TeraSync⑩ DDR/SDR FIFO x10 QUAD FIFO or x10/x20 DUAL FIFO CONFIGURATIONS |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| IDT72T54242L6-7BB | 功能描述:IC FIFO DDR/SDR QUAD/DUAL 324BGA RoHS:否 類別:集成電路 (IC) >> 邏輯 - FIFO 系列:72T 標(biāo)準(zhǔn)包裝:15 系列:74F 功能:異步 存儲容量:256（64 x 4） 數(shù)據(jù)速率:- 訪問時間:- 電源電壓:4.5 V ~ 5.5 V 工作溫度:0°C ~ 70°C 安裝類型:通孔 封裝/外殼:24-DIP（0.300"，7.62mm） 供應(yīng)商設(shè)備封裝:24-PDIP 包裝:管件 其它名稱:74F433 |
| IDT72T54242L6-7BBI | 功能描述:IC FIFO DDR/SDR QUAD/DUAL 324BGA RoHS:否 類別:集成電路 (IC) >> 邏輯 - FIFO 系列:72T 標(biāo)準(zhǔn)包裝:15 系列:74F 功能:異步 存儲容量:256（64 x 4） 數(shù)據(jù)速率:- 訪問時間:- 電源電壓:4.5 V ~ 5.5 V 工作溫度:0°C ~ 70°C 安裝類型:通孔 封裝/外殼:24-DIP（0.300"，7.62mm） 供應(yīng)商設(shè)備封裝:24-PDIP 包裝:管件 其它名稱:74F433 |
| IDT72T54252L5BB | 功能描述:IC FIFO DDR/SDR QUAD/DUAL 324BGA RoHS:否 類別:集成電路 (IC) >> 邏輯 - FIFO 系列:72T 標(biāo)準(zhǔn)包裝:15 系列:74F 功能:異步 存儲容量:256（64 x 4） 數(shù)據(jù)速率:- 訪問時間:- 電源電壓:4.5 V ~ 5.5 V 工作溫度:0°C ~ 70°C 安裝類型:通孔 封裝/外殼:24-DIP（0.300"，7.62mm） 供應(yīng)商設(shè)備封裝:24-PDIP 包裝:管件 其它名稱:74F433 |
| IDT72T54252L6-7BB | 功能描述:IC FIFO DDR/SDR QUAD/DUAL 324BGA RoHS:否 類別:集成電路 (IC) >> 邏輯 - FIFO 系列:72T 標(biāo)準(zhǔn)包裝:15 系列:74F 功能:異步 存儲容量:256（64 x 4） 數(shù)據(jù)速率:- 訪問時間:- 電源電壓:4.5 V ~ 5.5 V 工作溫度:0°C ~ 70°C 安裝類型:通孔 封裝/外殼:24-DIP（0.300"，7.62mm） 供應(yīng)商設(shè)備封裝:24-PDIP 包裝:管件 其它名稱:74F433 |
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