參數(shù)資料
型號: IDT7290820J
廠商: INTEGRATED DEVICE TECHNOLOGY INC
元件分類: 路由/交換
英文描述: TIME SLOT INTERCHANGE DIGITAL SWITCH 2,048 x 2,048
中文描述: TELECOM, DIGITAL TIME SWITCH, PQCC84
封裝: 1.150 X 1.150 INCH, 1.27 MM PITCH, PLASTIC, LCC-84
文件頁數(shù): 10/27頁
文件大?。?/td> 174K
代理商: IDT7290820J
10
COMMERCIAL TEMPERATURE RANGE
IDT7290820 5V TIME SLOT INTERCHANGE
DIGITAL SWITCH 2,048 x 2,048
)
$$*
+
*$$*
Delay for Variable Throughput Delay Mode
(m – output channel number)
(n – input channel number)
m = n, n+1, n+2
m-n + 32 time slots
m-n + 64 time-slots
m-n + 128 time-slots
Input Rate
m < n
m > n+2
mn time-slots
mn time slots
mn time-slots
2.048 Mb/s
4.096 Mb/s
8.192 Mb/s
32 – (n-m time-slots
64 – (n-m time-slots
128 – (n-m time-slots
Delay for Constant Throughput Delay Mode
(m – output channel number)
(n – input channel number)
32 + (32 – n) + mtime-slots
64 + (64 – n) + mtime-slots
128 + (128 – n) + mtime-slots
Input Rate
2.048 Mb/s
4.096 Mb/s
8.192 Mb/s
A7
(1)
A6
A5
A4
A3
A2
A1
A0
Location
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0
1
.
0
1
Control Register, CR
Interface Mode Selection Register, IMS
Frame Alignment Register, FAR
Frame Input Offset Register 0, FOR0
Frame Input Offset Register 1, FOR1
Frame Input Offset Register 2, FOR2
Frame Input Offset Register 3, FOR3
Ch0
Ch1
.
Ch30
Ch31
Ch32
Ch33
.
Ch62
Ch63
Ch64
Ch65
.
Ch126
Ch127
(Note 2)
(Note 3)
(Note 4)
Notes:
1. Bit A7 must be high for access to data and connection memory positions. Bit A7 must be low for access to registers.
2. Channels 0 to 31 are used when serial interface is at 2.048 Mb/s mode
3. Channels 0 to 63 are used when serial interface is at 4.096 Mb/s mode.
4. Channels 0 to 127 are used when serial interface is at 8.192 Mb/s mode.
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PDF描述
IDT7290820PF TIME SLOT INTERCHANGE DIGITAL SWITCH 2,048 x 2,048
IDT7290820PQF TIME SLOT INTERCHANGE DIGITAL SWITCH 2,048 x 2,048
IDT72T1855L4-4BB 2.5 VOLT HIGH-SPEED TeraSync FIFO 18-BIT/9-BIT CONFIGURATIONS
IDT72T1845L4-4BB 2.5 VOLT HIGH-SPEED TeraSync FIFO 18-BIT/9-BIT CONFIGURATIONS
IDT72T1865L4-4BB 2.5 VOLT HIGH-SPEED TeraSync FIFO 18-BIT/9-BIT CONFIGURATIONS
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