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參數(shù)資料
| 型號(hào)： | IDT728981DB |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 1/10頁 |
| 文件大小： | 0K |
| 描述： | IC DGTL SW 128X128 44-PQFP |
| 標(biāo)準(zhǔn)包裝： | 48 |
| 系列： | 7200 |
| 類型： | 多路復(fù)用器 |
| 電路： | 1 x 4:4 |
| 獨(dú)立電路： | 1 |
| 電壓電源： | 單電源 |
| 電源電壓： | 4.75 V ~ 5.25 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 44-QFP |
| 供應(yīng)商設(shè)備封裝： | 44-PQFP（10x10） |
| 包裝： | 托盤 |
| 其它名稱： | 728981DB |
1
JANUARY 2001
TIME SLOT INTERCHANGE
DIGITAL SWITCH
128 x 128
IDT728981
2001 Integrated Device Technology, Inc.
DSC-5703/1
.UNCTIONAL BLOCK DIAGRAM
.EATURES:
128 x 128 channel non-blocking switch
Serial Telecom Bus Compatible (ST-BUS)
4 RX inputs—32 channels at 64 Kbit/s per serial line
4 TX output—32 channels at 64 Kbit/s per serial line
Three-state serial outputs
Microprocessor Interface (8-bit data bus)
5V Power Supply
Available in 44-pin Plastic Leaded Chip Carrier (PLCC), 40-pin
Plastic Dip (P-DIP) and 44-pin Plastic Quad Flatpack (PQFP)
Operating Temperature Range -40
°°°°°C to +85°°°°°C
DESCRIPTION:
The IDT728981 is a ST-BUS compatible digital switch controlled by a
microprocessor. The IDT728981 can handle as many as 128, 64 Kbit/s input
and output channels. Those 128 channels are divided into 4 serial inputs and
outputs, each of which consists of 32 channels (64 Kbit/s per channel) to form
a multiplexed 2.048 Mb/s stream.
.UNCTIONAL DESCRIPTION
A functional block diagram of the IDT728981 device is shown below. The
serial streams operate continuously at 2.048 Mb/s and are arranged in 125
s
wide frames each containing 32, 8-bit channels. Four input (RX0-3) and four
output (TX0-3) serial streams are provided in the IDT728981 device allowing
a complete 128 x 128 channel non-blocking switch matrix to be constructed.
The serial interface (
C4i) clock for the device is 4.096 MHz.
Thereceivedserialdataisinternallyconvertedtoaparallelformatbytheon
chipserial-to-parallelconvertersandstoredsequentiallyina128-positionData
Memory.Byusinganinternalcounterthatisresetbytheinput8KHzframepulse,
F0i, the incoming serial data streams can be framed and sequentially ad-
dressed.
Microprocessor Interface
Control Register
Timing
Unit
RX0
RX1
RX2
RX3
TX0
TX1
TX2
TX3
ODE
F0i
C4i
VCC
CS
DS
R/
W A0/
A5
GND
DTA D0/
D7
5703 drw01
Data
Memory
Output MUX
Connection
Memory
Receive
Serial Data
Streams
Transmit
Serial Data
Streams
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PDF描述 |
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參數(shù)描述 |
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