參數(shù)資料
型號(hào)： IDT72831L25TFI
廠商： INTEGRATED DEVICE TECHNOLOGY INC
元件分類： DRAM
英文描述： DUAL CMOS SyncFIFO
中文描述： 2K X 9 BI-DIRECTIONAL FIFO, 15 ns, PQFP64
封裝： SLIM, TQFP-64
文件頁(yè)數(shù)： 9/16頁(yè)
文件大小： 169K
代理商： IDT72831L25TFI
9
Commercial And Industrial Temperature Range
IDT72801/728211/72821/72831/72841/72851
NOTES:
1. Holding WENA2/
LDA
(WENB2/
LDB
) HIGH during reset will make the pin act as a second write enable pin. Holding WENA2/
LDA
(WENB2/
LDB
) LOW
during reset will make the pin act as a load enable for the programmable flag offset registers.
2.
After reset, QA0 - QA8 (QB0 - QB8) will be LOW if
OEA
(
OEB
) = 0 and tri-state if
OEA
(
OEB
) = 1.
3.
The clocks RCLKA, WCLKA (RCLKB, WCLKB) can be free-running during reset.
Figure 4. Reset Timing
t
RS
t
RSR
RSA
(
RSB
)
RENA1
,
RENA2
(
RENB1
,
RENB2
)
t
RSF
t
RSF
OEA
(
OEB
) = 1
OEA
(
OEB
) = 0
(2)
EFA
,
PAEA
(
EFB
,
PAEB
)
FFA
,
PAFA
(
FFB
,
PAFB
)
QA
0
- QA
8
(QB
0
- QB
8
)
3034 drw 05
WENA1
(
WENB1
)
t
RSS
t
RSF
t
RSR
t
RSS
t
RSR
t
RSS
WENA2/
LDA
(WENB2/
LDB
)
(1)
NOTE:
1.
t
SKEW1
is the mnimumtime between a rising RCLKA (RCLKB) edge and a rising WCLKA (WCLKB) edge for
FFA
(
FFB
) to change during the current clock cycle. If the time between
the rising edge of RCLKA (RCLKB) and the rising edge of WCLKA (WCLKB) is less than t
SKEW1
, then
FFA
(
FFB
) may not change state until the next WCLKA (WCLKB) edge.
Figure 5. Write Cycle Timing
t
DH
t
ENH
t
SKEW1(1)
t
CLK
t
CLKH
t
CLKL
t
DS
t
ENS
t
WFF
t
WFF
WCLKA (WCLKB)
DA
0
- DA
8
(DB
0
- DB
8
)
WENA1
(
WENB1
)
WENA2 (WENB2)
(If Applicable)
FFA
(
FFB
)
RCLKA (RCLKB)
RENA1
,
RENA2
(
RENB1
,
RENB2)
NO OPERATION
NO OPERATION
3034 drw 06
DATA IN VALID
t
ENS
t
ENH
相關(guān)PDF資料
PDF描述
IDT72841L10PF DUAL CMOS SyncFIFO
IDT72841L10PFI DUAL CMOS SyncFIFO
IDT72841L10TF DUAL CMOS SyncFIFO
IDT72841L10TFI DUAL CMOS SyncFIFO
IDT72841L15PFI DUAL CMOS SyncFIFO
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
IDT72831L25TFI8 功能描述:IC FIFO SYNC DUAL 2048X9 64-TQFP RoHS:否 類別:集成電路 (IC) >> 邏輯 - FIFO 系列:7200 標(biāo)準(zhǔn)包裝:90 系列:7200 功能:同步 存儲(chǔ)容量:288K（16K x 18） 數(shù)據(jù)速率:100MHz 訪問(wèn)時(shí)間:10ns 電源電壓:4.5 V ~ 5.5 V 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:64-LQFP 供應(yīng)商設(shè)備封裝:64-TQFP（14x14） 包裝:托盤 其它名稱:72271LA10PF
IDT72835LB10PF 功能描述:IC FIFO SYNC DL 2048X18 128TQFP RoHS:否 類別:集成電路 (IC) >> 邏輯 - FIFO 系列:7200 標(biāo)準(zhǔn)包裝:90 系列:7200 功能:同步 存儲(chǔ)容量:288K（16K x 18） 數(shù)據(jù)速率:100MHz 訪問(wèn)時(shí)間:10ns 電源電壓:4.5 V ~ 5.5 V 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:64-LQFP 供應(yīng)商設(shè)備封裝:64-TQFP（14x14） 包裝:托盤 其它名稱:72271LA10PF
IDT72835LB10PF8 功能描述:IC FIFO SYNC DL 2048X18 128TQFP RoHS:否 類別:集成電路 (IC) >> 邏輯 - FIFO 系列:7200 標(biāo)準(zhǔn)包裝:90 系列:7200 功能:同步 存儲(chǔ)容量:288K（16K x 18） 數(shù)據(jù)速率:100MHz 訪問(wèn)時(shí)間:10ns 電源電壓:4.5 V ~ 5.5 V 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:64-LQFP 供應(yīng)商設(shè)備封裝:64-TQFP（14x14） 包裝:托盤 其它名稱:72271LA10PF
IDT72835LB15PF 功能描述:IC FIFO SYNC DL 2048X18 128TQFP RoHS:否 類別:集成電路 (IC) >> 邏輯 - FIFO 系列:7200 標(biāo)準(zhǔn)包裝:90 系列:7200 功能:同步 存儲(chǔ)容量:288K（16K x 18） 數(shù)據(jù)速率:100MHz 訪問(wèn)時(shí)間:10ns 電源電壓:4.5 V ~ 5.5 V 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:64-LQFP 供應(yīng)商設(shè)備封裝:64-TQFP（14x14） 包裝:托盤 其它名稱:72271LA10PF
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