參數(shù)資料
型號(hào)： IDT72605L50J
廠商： INTEGRATED DEVICE TECHNOLOGY INC
元件分類： DRAM
英文描述： CMOS SyncBiFIFOO 256 x 18 x 2 and 512 x 18 x 2
中文描述： 256 X 18 BI-DIRECTIONAL FIFO, 25 ns, PQCC68
封裝： PLASTIC, LCC-68
文件頁(yè)數(shù)： 17/20頁(yè)
文件大?。?/td> 209K
代理商： IDT72605L50J
IDT72605/IDT72615 CMOS SyncBiFIFO
256 x 18 x 2 and 512 x 18 x 2
COMMERCIAL TEMPERATURE RANGE
5.18
17
CLK
B
CLK
A
D
B0
-D
B17
R/W
B
R/W
A
EN
A
D
A0
-D
A17
OE
A
BA
EF
A ,
2
A ,
0
A ,
1
BA
FF
EN
B
DATA OUTPUT
t
A
t
OLZ
t
OE
t
CS
DATA INPUT
BYPASS FLAG
FIFO FLAG
t
FF
t
DS
t
SKEW1
t
EF
t
EF
t
EF
BYPASS FLAG
FIFO FLAG
t
OHZ
FIFO FLAG
t
CS
t
CH
t
SKEW1
t
EF
t
SKEW1
t
CS
CS
A
B
BYP
t
FF
t
FF
t
FF
t
CS
t
CS
= 001
A ,
0
A ,
2
A ,
1
t
SKEW1
2704 drw 15
NOTES:
1. When
CS
A
is brought HIGH, A
→
B Bypass mode will switch to FIFO mode on the following CLK
A
going LOW-to-HIGH.
2. After the bypass operation is completed, the
BYP
B
goes from LOW-to-HIGH; this will reset all bypass flags. The bypass path becomes available for
the next bypass operation.
3. When A-side changed from bypass mode into FIFO mode, B-side only has one cycle to read the bypass data. On the next cycle, B-side will be
forced back to FIFO mode.
Figure 11. B
→
A Bypass Timing
相關(guān)PDF資料
PDF描述
IDT72615L50J CMOS SyncBiFIFOO 256 x 18 x 2 and 512 x 18 x 2
IDT72605L50PF CMOS SyncBiFIFOO 256 x 18 x 2 and 512 x 18 x 2
IDT72615L50PF CMOS SyncBiFIFOO 256 x 18 x 2 and 512 x 18 x 2
IDT72811 DUAL CMOS SyncFIFO
IDT72831L12PF DUAL CMOS SyncFIFO
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
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