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參數(shù)資料
| 型號： | IDT723641L30PQF |
| 廠商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分類： | DRAM |
| 英文描述： | Quad, High Slew Rate, Single-Supply, Op Amp 14-TSSOP -40 to 105 |
| 中文描述： | 1K X 36 OTHER FIFO, 15 ns, PQFP132 |
| 封裝： | PLASTIC, QFP-132 |
| 文件頁數(shù)： | 8/23頁 |
| 文件大?。?/td> | 269K |
| 代理商： | IDT723641L30PQF |
8
IDT723631/723641/723651 CMOS SyncFIFO
512 x 36, 1024 x 36, 2048 x 36
COMMERCIAL TEMPERATURE RANGE
IDT723631L15 IDT723631L20 IDT723631L30
IDT723641L15 IDT723641L20 IDT723641L30
IDT723651L15 IDT723651L20 IDT723651L30
Min.
Max.
Min.
–
66.7
–
3
11
3
1
8
1
1
8
1
1
8
1
1
8
1
0
8
0
Symbol
f
S
t
A
t
PIR
t
POR
t
PAE
t
PAF
t
PMF
Parameter
Max.
50
13
10
10
10
10
10
Min.
–
3
1
1
1
1
0
Max.
33.4
15
12
12
12
12
12
Unit
MHz
ns
ns
ns
ns
ns
ns
Clock Frequency, CLKA or CLKB
Access Time, CLKB
↑
to B0-B35
Propagation Delay Time, CLKA
↑
to IR
Propagation Delay Time, CLKB
↑
to OR
Propagation Delay Time, CLKB
↑
to
AE
Propagation Delay Time, CLKA
↑
to
AF
Propagation Delay Time, CLKA
↑
to
MBF1
LOW or
MBF2
HIGH and CLKB
↑
to
MBF2
LOW or
MBF1
HIGH
Propagation Delay Time, CLKA
↑
to B0-B35
(1)
and CLKB
↑
to A0-A35
(2)
Propagation Delay Time, MBB to B0-B35 Valid
Propagation Delay Time,
RST
LOW to
AE
LOW
and
AF
HIGH
Enable Time,
CSA
and W/
R
A LOW to A0-A35
Active and
CSB
LOW and
W
/RB HIGH to
B0-B35 Active
Disable Time,
CSA
or W/
R
A HIGH to A0-A35
at high impedance and
CSB
HIGH or
W
/RB
LOW to B0-B35 at high impedance
t
PMR
3
13.5
3
15
3
17
ns
t
MDV
t
RSF
3
1
13
15
3
1
15
20
3
1
17
30
ns
ns
t
EN
2
12
2
13
2
14
ns
t
DIS
1
8
1
10
1
11
ns
AC ELECTRICAL CHARACTERISTICS
NOTES:
1. Writing data to the mail1 register when the B0-B35 outputs are active and MBB is HIGH.
2. Writing data to the mail2 register when the A0-A35 outputs are active and MBA is HIGH.
3023 tbl 07
相關(guān)PDF資料 |
PDF描述 |
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