參數(shù)資料
型號: IDT723632L30PF
廠商: INTEGRATED DEVICE TECHNOLOGY INC
元件分類: DRAM
英文描述: CMOS SyncBiFIFOO 256 x 36 x 2, 512 x 36 x 2, 1024 x 36 x 2
中文描述: 512 X 36 BI-DIRECTIONAL FIFO, 15 ns, PQFP120
封裝: TQFP-120
文件頁數(shù): 9/26頁
文件大?。?/td> 294K
代理商: IDT723632L30PF
5.22
9
IDT723622/723632/723642 CMOS SyncBiFIFO
256 x 36 x 2, 512 x 36 x 2, 1024 x 36 x 2
COMMERCIAL TEMPERATURE RANGE
NOTES:
1. Writing data to the mail1 register when the B0-B35 outputs are active and MBB is HIGH.
2. Writing data to the mail2 register when the A0-A35 outputs are active and MBA is HIGH.
SWITCHING CHARACTERISTICS OVER RECOMMENDED RANGES OF SUPPLY VOLTAGE
AND OPERATING FREE-AIR TEMPERATURE, C
L
= 30 pF
723622L15
723632L15
723642L15
Min.
3
723622L20
723632L20
723642L20
Min.
3
723622L30
723632L30
723642L30
Min.
3
Symbol
t
A
Parameter
Max.
11
Max.
13
Max.
15
Unit
ns
Access Time, CLKA
to A0-A35 and CLKB
to B0-B35
Propagation Delay Time, CLKA
to IRA and
CLKB
to IRB
Propagation Delay Time, CLKA
to ORA and
CLKB
to ORB
Propagation Delay Time, CLKA
to
AEA
and
CLKB
to
AEB
Propagation Delay Time, CLKA
to
AFA
and
and CLKB
to
AFB
Propagation Delay Time, CLKA
to
MBF1
LOW or
MBF2
HIGH and CLKB
to
MBF2
LOW or
MBF1
HIGH
Propagation Delay Time, CLKA
to B0-B35
(1)
and
CLKB
to A0-A35
(2)
Propagation Delay Time, MBA to A0-A35 valid and
MBB to B0-B35 Valid
Propagation Delay Time,
RST1
LOW to
AEB
LOW,
AFA
HIGH, and
MBF1
HIGH, and
RST2
LOW to
AEA
LOW,
AFB
HIGH, and
MBF2
HIGH
Enable Time,
CSA
and W/
R
A LOW to A0-A35 Active
and
CSB
LOW and
W
/RB HIGH to B0-B35 Active
Disable Time,
CSA
or W/
R
A HIGH to A0-A35 at
high impedance and
CSB
HIGH or
W
/RB LOW
to B0-B35 at HIGH impedance
t
PIR
2
8
2
10
2
12
ns
t
POR
1
8
1
10
1
12
ns
t
PAE
1
8
1
10
1
12
ns
t
PAF
1
8
1
10
1
12
ns
t
PMF
0
8
0
10
0
12
ns
t
PMR
3
13.5
3
15
3
17
ns
t
MDV
3
11
3
13
3
15
ns
t
PRF
1
15
1
20
1
30
ns
t
EN
2
12
2
13
2
14
ns
t
DIS
1
8
1
10
1
11
ns
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