參數(shù)資料
型號: IDT723626L12PF
廠商: INTEGRATED DEVICE TECHNOLOGY INC
元件分類: DRAM
英文描述: Quad, High Slew Rate, Single-Supply, Op Amp 14-SOIC 0 to 70
中文描述: 256 X 36 BI-DIRECTIONAL FIFO, 8 ns, PQFP128
封裝: TQFP-128
文件頁數(shù): 18/35頁
文件大?。?/td> 563K
代理商: IDT723626L12PF
18
COMMERCIAL TEMPERATURE RANGE
IDT723626/723636/723646 CMOS TRIPLE BUS SyncFIFO
WITH BUS-MATCHING 256 x 36 x 2, 512 x 36 x 2 and 1,024 x 36 x 2
NOTES:
1.
PRS2
and MBC must be HIGH during Master Reset until the rising edge of
FFC
/IRC goes HIGH.
2. If BE/
FWFT
is HIGH, then
EFA
/ORA will go LOW one CLKA cycle earlier than in this case where BE/
FWFT
is LOW.
3.
MRS2
must toggle simultaneously with
MRS1
.
Figure 5. FIFO2 Master Reset and Loading X2 and Y2 with a Preset Value of Eight (IDT Standard and FWFT Modes)
CLKC
MRS2
(3)
FFC
/IRC
AEA
AFC
MBF2
CLKA
EFA
/ORA
FS1,FS0
3271 drw06
t
RSTS
t
RSTH
t
FSH
t
FSS
t
WFF
t
WFF
t
REF
t
RSF
0,1
t
RSF
t
RSF
BE
BE/
FWFT
SPM
FWFT
t
BES
t
SPMS
t
BEH
t
SPMH
1
2
t
FWS
(2)
Figure 4. FIFO1 Master Reset and Loading X1 and Y1 with a Preset Value of Eight (IDT Standard and FWFT Modes)
NOTES:
1.
PRS1
and MBC must be HIGH during Master Reset until the rising edge of
FFA
/IRA goes HIGH.
2. If BE/
FWFT
is HIGH, then
EFB
/ORB will go LOW one CLKB cycle earlier than in this case where BE/
FWFT
is LOW.
CLKA
MRS1
FFA
/IRA
AEB
AFA
MBF1
CLKB
EFB
/ORB
FS1,FS0
3271 drw05
t
RSTS
t
RSTH
t
FSH
t
FSS
t
WFF
t
WFF
t
REF
t
RSF
0,1
t
RSF
t
RSF
BE
BE/
FWFT
SPM
FWFT
t
BES
t
SPMS
t
BEH
t
SPMH
1
2
t
FWS
(2)
相關(guān)PDF資料
PDF描述
IDT723626L15PF Quad, High Slew Rate, Single-Supply, Op Amp 14-SOIC 0 to 70
IDT723636 Quad, High Slew Rate, Single-Supply, Op Amp 14-SOIC -40 to 105
IDT723632L15PF CMOS SyncBiFIFOO 256 x 36 x 2, 512 x 36 x 2, 1024 x 36 x 2
IDT723632L15PQF CMOS SyncBiFIFOO 256 x 36 x 2, 512 x 36 x 2, 1024 x 36 x 2
IDT723632L20PF CMOS SyncBiFIFOO 256 x 36 x 2, 512 x 36 x 2, 1024 x 36 x 2
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參數(shù)描述
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