參數(shù)資料
型號: IDT723614L30PF
廠商: INTEGRATED DEVICE TECHNOLOGY INC
元件分類: DRAM
英文描述: 8349 TBGA NO PB W/ ENC
中文描述: 128 X 36 BI-DIRECTIONAL FIFO, PQFP120
封裝: TQFP-120
文件頁數(shù): 27/39頁
文件大?。?/td> 499K
代理商: IDT723614L30PF
27
COMMERCIAL TEMPERATURE RANGE
IDT723614 CMOS SyncBiFIFO
WITH BUS MATCHING AND BYTE SWAPPING
64 x 36 x 2
NOTES:
1.
t
SKEW1
is the minimum time between a rising CLKA edge and a rising CLKB edge for
EFB
to transition HIGH in the next CLKB cycle. If the time
between the rising CLKA edge and rising CLKB edge is less than t
SKEW1
, then the transition of
EFB
HIGH may occur one CLKB cycle later than
shown.
Port-B size of long word is selected for FIFO1 read by SIZ1 = LOW, SIZ0 = LOW. If port-B size is word or byte,
EFB
is set LOW by the last word or
byte read from FIFO1, respectively.
2.
CSA
W
R
A
MBA
FFA
A0 - A35
CLKB
EFB
CSB
W/
R
B
SIZ1,
SIZ0
ENA
ENB
B0 -B35
CLKA
1
2
3146 drw 13
t
CLKH
t
CLKL
t
CLK
t
ENS
t
ENS
t
ENH
t
ENH
t
DS
t
DH
t
SKEW1
t
CLK
t
CLKL
t
ENS
t
ENH
t
A
W1
FIFO1 Empty
LOW
HIGH
LOW
LOW
LOW
t
CLKH
W1
HIGH
(1)
t
REF
t
REF
Figure13.
EFB
Flag Timing and First Data Read when FIFO1 is Empty
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PDF描述
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