參數(shù)資料
型號： IDT723612L20PF
廠商： INTEGRATED DEVICE TECHNOLOGY INC
元件分類： DRAM
英文描述： BiCMOS SyncBiFIFOO 64 x 36 x 2
中文描述： 64 X 36 BI-DIRECTIONAL FIFO, 12 ns, PQFP120
封裝： TQFP-120
文件頁數(shù)： 27/29頁
文件大小： 350K
代理商： IDT723612L20PF
27
COMMERCIAL TEMPERATURE RANGE
IDT723612 BiCMOS SyncBiFIFO
64 x 36 x 2
Figure 20
CALCULATING POWER DISSIPATION
The I
CC(f)
current for the graph in Figure 20 was taken while simultaneously reading and writing the FIFO on the
IDT723612 with CLKA and CLKB set to f
S
. All data inputs and data outputs change state during each clock cycle to
consume the highest supply current. Data outputs were disconnected to normalize the graph to a zero-capacitance load.
Once the capacitance load per data-output channel is known, the power dissipation can be calculated with the equation
below.
With I
CC(f
) taken from Figure 28, the maximum power dissipation (P
D
) of the IDT723612 may be calculated by:
P
D
= V
CC
x I
CC(f)
+
∑
(C
L
x V
CC
x (V
OH
- V
OL
)
x
f
o
)
where:
C
L
=
output capacitance load
f
o
=
switching frequency of an output
V
OH
=
output HIGH level voltage
V
OL
=
output LOW level voltage
When no reads or writes are occurring on the IDT723612, the power dissipated by a single clock (CLKA or CLKB)
input running at frequency f
S
is calculated by:
P
T
= V
CC
x f
S
x 0.290 mA/MHz
TYPICAL CHARACTERISTICS
SUPPLY CURRENT
vs
CLOCK FREQUENCY
0
10
20
30
40
50
60
80
0
50
100
150
200
250
300
350
400
VCC = 5.0 V
– Clock Frequency – MHz
fs
IC
fdata= 1/2
TA= 25
°
C
CL= 0 pF
VCC = 4.5 V
VCC = 5.5 V
3136 drw 23
70
s
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PDF描述
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