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參數(shù)資料
| 型號： | IDT71V3548S100BGI |
| 廠商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分類： | DRAM |
| 英文描述： | 256K x 18 3.3V Synchronous ZBT SRAM 3.3V I/O, Burst Counter Pipelined Outputs |
| 中文描述： | 256K X 18 ZBT SRAM, 5 ns, PBGA119 |
| 封裝： | 14 X 22 MM, PLASTIC, BGA-119 |
| 文件頁數(shù)： | 5/26頁 |
| 文件大小： | 494K |
| 代理商： | IDT71V3548S100BGI |
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6.42
IDT71V3548, 256K x 18, 3.3V Synchronous SRAMS with
ZBT
Feature, 3.3V I/O, Burst Counter, and Pipelined Outputs Commercial and Industrial Temperature Ranges
Pin Configuration - 256K x 18, 119 BGA
5
1
2
3
4
5
6
7
A
V
DDQ
A
6
A
4
NC(2)
A
8
A
16
V
DDQ
B
NC
CE2
A
3
ADV/
LD
A
9
CE
2
NC
C
A
7
A
2
V
DD
A
13
A
17
NC
D
I/O
8
NC
V
SS
NC
V
SS
I/O
7
NC
E
NC
I/O
9
V
SS
V
SS
NC
I/O
6
F
V
DDQ
NC
V
SS
OE
V
SS
I/O
5
V
DDQ
G
NC
I/O
10
BW
2
NC
I/O
4
H
I/O
11
NC
V
SS
R/
W
V
SS
I/O
3
NC
J
V
DDQ
V
DD
V
DD
V
DD
V
DDQ
K
NC
I/O
12
V
SS
CLK
V
SS
NC
I/O
2
L
I/O
13
NC
NC
BW
1
I/O
1
NC
M
V
DDQ
I/O
14
V
SS
CEN
V
SS
NC
V
DDQ
N
I/O
15
NC
V
SS
A
1
V
SS
I/O
0
NC
P
NC
I/O
P2
V
SS
A
0
V
SS
NC
I/O
P1
R
NC
A
5
LBO
V
DD
A
12
T
NC
A
10
A
15
NC
A
14
A
11
NC/ZZ(5)
U
V
DDQ
V
DDQ
5296 drw 13
NC
DD(1)
V
NC
V
SS
V
SS
CE
1
NC(2)
V
DD(1)
V
DD(1)
,
NC/TMS
(3)
NC/
TRST
(3,4)
NC/TDO
(3)
NC/TCK
(3)
NC/TDI
(3)
Top View
NOTES:
1. J3, J5, and R5 do not have to be directly connected to V
DD
as long as the input voltage is
≥
V
IH
.
2. G4 and A4 are reserved for future 8Mand 16Mrespectively.
3. These pins are NC for the "S" version and the JTAG signal listed for the "SA" version.
4.
TRST
is offered as an optional JTAG reset if required in the application. If not needed, can be left floating and will internally be pulled to V
DD.
5. Pin T7 supports ZZ (sleep mode) on the latest die revision.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| IDT71V3548S100BQ | 256K x 18 3.3V Synchronous ZBT SRAM 3.3V I/O, Burst Counter Pipelined Outputs |
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